基于DSP的導航計算機硬件設計
發(fā)布時間:2017-03-19 09:05
本文關鍵詞:基于DSP的導航計算機硬件設計,由筆耕文化傳播整理發(fā)布。
【摘要】:本論文研究數字信號處理芯片(DSP)在捷聯(lián)式慣性導航系統(tǒng)導航計算機中的應用,提出了一種基于DSP、單片機和大規(guī)?删幊踢壿嬈骷(CPLD)構建導航計算機系統(tǒng)硬件平臺的新方法。 文中結合現(xiàn)代導航技術發(fā)展的特點和導航計算機系統(tǒng)的實際需求,詳細闡述了導航計算機硬件設計的主要設計思想,經過分析研究和選型,設計了導航計算機系統(tǒng)的總體方案和硬件電路。本系統(tǒng)設計采用DSP+單片機的雙CPU體系結構方案,DSP主要負責數據的處理,單片機主要負責系統(tǒng)的輸入輸出控制,兩者結合實現(xiàn)優(yōu)勢互補,充分發(fā)揮各自的特長。此外,如何解決好DSP與單片機的接口與數據通訊問題是設計DSP與單片機雙CPU控制系統(tǒng)的關鍵。經過分析論證,本文提出了一種結構簡單、成本低且易于實現(xiàn)的雙機通信方法。系統(tǒng)中,單片機通過CPLD擴展雙總線,并利用其中一條總線與DSP模塊共享片外存儲器。文中設計了雙機通訊的具體流程,然后利用CPLD開發(fā)工具編程實現(xiàn)并進行了時序仿真。 研究表明,基于DSP設計的導航計算機,可以有效地提高捷聯(lián)慣導系統(tǒng)的運算精度和速度,減小系統(tǒng)的體積、功耗和成本,使系統(tǒng)具備更好的應用價值、市場前景和軍事意義。
【關鍵詞】:捷聯(lián)慣性導航系統(tǒng) 導航計算機 DSP 雙CPU CPLD
【學位授予單位】:國防科學技術大學
【學位級別】:碩士
【學位授予年份】:2004
【分類號】:V247.11
【目錄】:
- 摘要5-6
- ABSTRACT6-7
- 第一章 緒論7-12
- 1.1 捷聯(lián)慣導系統(tǒng)的發(fā)展概況7-8
- 1.2 DSP在控制領域中的應用及發(fā)展趨勢8-10
- 1.3 課題研究的背景和意義10-11
- 1.4 論文的主要內容和結構安排11-12
- 第二章 系統(tǒng)整體設計思想12-27
- 2.1 基于DSP設計導航計算機的優(yōu)越性12-16
- 2.2 系統(tǒng)需求分析16-18
- 2.2.1 功能需求16-17
- 2.2.2 性能需求17-18
- 2.3 系統(tǒng)的DSP選型18-20
- 2.3.1 選型依據18-19
- 2.3.2 TMS320VC33的硬件資源19-20
- 2.4 系統(tǒng)主要設計思想20-25
- 2.4.1 雙CPU結構設計思想20-22
- 2.4.2 雙CPU通訊設計思想22-24
- 2.4.3 單片機擴展雙總線設計思想24-25
- 2.5 系統(tǒng)組成25-26
- 本章小結26-27
- 第三章 系統(tǒng)硬件平臺的實現(xiàn)27-46
- 3.1 DSP模塊設計27-35
- 3.1.1 DSP模塊功能結構27
- 3.1.2 存儲器設計27-31
- 3.1.3 BootLoader設計31-32
- 3.1.4 電源設計32-33
- 3.1.5 時鐘設計33-34
- 3.1.6 JTAG仿真口設計34-35
- 3.2 單片機模塊設計35-43
- 3.2.1 單片機模塊功能結構35
- 3.2.2 單片機選型35-39
- 3.2.3 單片機設計39-41
- 3.2.4 擴展串口設計41-43
- 3.3 CPLD接口設計43-44
- 3.4 電路板基本測試44
- 本章小結44-46
- 第四章 系統(tǒng)雙機通訊的實現(xiàn)46-58
- 4.1 CPLD設計概述46-48
- 4.1.1 Xilinx CPLD的特點46
- 4.1.2 Xilinx CPLD的設計流程46-48
- 4.2 雙機通訊設計48-57
- 4.2.1 通訊流程設計48-49
- 4.2.2 實現(xiàn)方法49-50
- 4.2.3 CPLD設計50-54
- 4.2.4 CPLD仿真54-57
- 本章小結57-58
- 結論與展望58-59
- 致謝59-60
- 參考文獻60-61
【引證文獻】
中國碩士學位論文全文數據庫 前10條
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本文關鍵詞:基于DSP的導航計算機硬件設計,,由筆耕文化傳播整理發(fā)布。
本文編號:255810
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