本文關(guān)鍵詞：微型計(jì)算機(jī)原理及應(yīng)用

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《微型計(jì)算機(jī)原理題庫》答案

第一章 數(shù)碼轉(zhuǎn)換

1-1. 10000000B

1-2. 00101101B

1-3. 43H

1-4. 11BH

1-5. 0.BH

1-6. 0.1011B

1-7. 23

1-8. 5.375

1-9. 2495.5

1-10. 4A8.E738H

1-11. 11001101.1101B

1-12. 13.2Q

1-13. 474.1875

1-14. 2C.AH

1-15. 1001010.10110011B

1-16. 1010011.001010011B 1-17. 53.298H

1-18. 00101011B

1-19. 10111101B

1-20. 00101011B

1-21. 11000010B

1-22. 00101011B

1-23. 11000011B

1-24. (100000011001)BCD

1-25. 397.5

1-26. 30H

1-27. 39H

1-28. 41H

1-29. 61H

1-30. 11111111B

1-31. 00110101B

1-32. 01010011B

1-33. 11000100B

第二章 計(jì)算機(jī)組成

2-1. 字長、時(shí)鐘頻率、運(yùn)算速度、內(nèi)存容量

2-2. MHz

2-3. 操作系統(tǒng)，各種程序設(shè)計(jì)語言的處理程序，數(shù)據(jù)庫管理系統(tǒng)，診斷程序以及系統(tǒng)服務(wù)

程序等。

2-4. 科學(xué)計(jì)算程序，字表處理軟件，工資管理程序，人事管理程序，財(cái)務(wù)管理程序以及計(jì)

算機(jī)輔助設(shè)計(jì)與制造，輔助教學(xué)等軟件

2-5. 8

2-6. 65536

2-7. 1048576

2-8. 4096MB

2-9. 機(jī)器語言

2-10. 二進(jìn)制數(shù)真值是(+1100101)2，，十進(jìn)制數(shù)真值是(+101)10

2-11. (10110110)2

2-12. 分時(shí)方式

2-13. 執(zhí)行部件(EU)和總線接口部件(BIU)

2-14. 4個(gè)通用寄存器(AX, BX, CX, DX)，4個(gè)專用寄存器(BP, SP, SI, DI)，1個(gè)標(biāo)志寄存器

(FLAGS)和算術(shù)邏輯單元(ALU)

2-15. 4個(gè)16位段寄存器(CS, DS, SS, ES)，1個(gè)16位指令指針(IP)，6個(gè)字節(jié)指令隊(duì)列，20

位地址加法器和總線控制電路

2-16. 程序計(jì)數(shù)器(PC)

2-17. 分為狀態(tài)標(biāo)志和控制標(biāo)志。

狀態(tài)標(biāo)志包括：進(jìn)位(CF)、符號(hào)(SF)、零(ZF)、溢出(OF)、奇偶(PF)、輔助(AF) 控制標(biāo)志包括：中斷(IF)、方向(DF)、單步(TF)

2-18. 物理地址、邏輯地址

2-19. 20bit，范圍是00000H~FFFFFH

2-20. 段基址和偏移地址、公式是段基址*16+偏移地址、段基址是存放在段寄存器中 2-21. 每個(gè)邏輯段≤64KB；16個(gè)字節(jié)為一節(jié)、256個(gè)字節(jié)為1頁，每個(gè)邏輯段須從節(jié)的整數(shù)

邊界開始

2-22. 利用準(zhǔn)備好(READY)信號(hào)插入TW

2-23. 從偶地址讀/寫要1個(gè)總線周期、從奇地址讀/寫要用2個(gè)總線周期

2-24. 存儲(chǔ)器進(jìn)行連續(xù)讀寫操作所允許的最短時(shí)間間隔

2-25. RAM包括靜態(tài)RAM和動(dòng)態(tài)RAM兩類

2-26. EPROM是指可擦寫可編程的只讀存儲(chǔ)器

2-27. 虛擬存儲(chǔ)器是指可以容納總和超過主存容量的多個(gè)作業(yè)同時(shí)運(yùn)行的一個(gè)地址空間 2-28. 擴(kuò)大內(nèi)存的尋址空間

2-29. 主存  外存

2-30. (CS)=FFFFH, (DS)=0000H

(SS)=0000H, (ES)=0000H

(IP)=0000H, (FR)=0000H (禁止中斷)

指令隊(duì)列空；執(zhí)行第一條指令的地址是FFFF0H

2-31. 靜態(tài)RAM靠觸發(fā)器原理存儲(chǔ)信息

動(dòng)態(tài)RAM靠電容存儲(chǔ)電荷的原理存儲(chǔ)信息

2-32. 刷新

2-33. 線性譯碼和雙重譯碼

2-34. 目的是解決CPU與主存之間的速度匹配問題

2-35. 主要受計(jì)算機(jī)的編址范圍的影響

2-36. 分為片總線、內(nèi)總線、外總線

2-37. 片總線又稱元件級(jí)總線，是芯片內(nèi)部引出的總線，是用微處理器構(gòu)成一個(gè)部件或一個(gè)

很小的系統(tǒng)時(shí)傳輸信息的通路。各類微處理器的引腳信號(hào)即為片總線。片總線通常包括數(shù)據(jù)總線、地址總線和控制總線等三組總線

2-38. 內(nèi)總線又稱為系統(tǒng)總線，即微機(jī)總線，是微機(jī)系統(tǒng)中各插件之間信息傳輸?shù)耐�，�?/p>

有S-100總線、STD總線、MULTIBUS總線等。32位出現(xiàn)后，又推出MCA，EISA等32位機(jī)總線

2-39. 外總線又稱為通訊總線，是各微機(jī)系統(tǒng)之間或微機(jī)系統(tǒng)與其它系統(tǒng)之間信息傳輸?shù)耐?/p>

路，常用的有RS-232C總線、IEEE-488總線等。

2-40. 可按聽者、講者、控制者三種方式工作

2-41. 25

2-42. STD共定義了56條導(dǎo)線。適合8位微處理器

2-43. 控制總線提供的信號(hào)有①所有存儲(chǔ)器和I/O設(shè)備的時(shí)序信號(hào)和控制信號(hào)，②來自I/O

設(shè)備和存儲(chǔ)器的響應(yīng)信號(hào)。

2-44. 地址總線的作用是用于指定存儲(chǔ)單元和I/O設(shè)備接口電路的選擇地址

2-45. 暫存預(yù)取指令

2-46. 6個(gè)

2-47. 4個(gè)

2-48. 2個(gè)

2-49. 1個(gè)

2-50. 隊(duì)列為空

2-51. 8284A提供的主要功能有：頻率恒定的時(shí)鐘信號(hào)，同時(shí)對(duì)準(zhǔn)備好(READY)信號(hào)和復(fù)位

(RESET)信號(hào)進(jìn)行同步。

2-52. ①指令周期 ②機(jī)器周期 ③時(shí)鐘周期

2-53. 是主頻和平均指令執(zhí)行速度

2-54. 功能是從主存取出指令、分析指令并產(chǎn)生相關(guān)的操作控制信號(hào)

2-55. 算術(shù)運(yùn)算與邏輯運(yùn)算

2-56. 存儲(chǔ)器的容量

2-57. 由指令字長決定

2-58. CPU用BHE選擇奇體，用A0選擇偶體，每個(gè)存儲(chǔ)體內(nèi)存單元的選擇信號(hào)是A19~A1 2-59. AD0

2-60. MN/MX

本文編號(hào)：581153