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111. 32位微處理器一級(jí)指令Cache中SRAM的設(shè)計(jì)
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112. 利用多維分級(jí)Cache替換策略減少對(duì)PCM內(nèi)存寫(xiě)回量
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113. 一種并行計(jì)算機(jī)互連網(wǎng)絡(luò)中的地址轉(zhuǎn)換Cache
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114. 一種多核SoC中基于Cache機(jī)制的存儲(chǔ)結(jié)構(gòu)設(shè)計(jì)
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115. 面向延遲優(yōu)化的多核處理器Cache數(shù)據(jù)管理機(jī)制研究
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116. 基于CMP的共享L2Cache管理策略研究
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117. “螢火蟲(chóng)2號(hào)GPU”中像素cache的設(shè)計(jì)與實(shí)現(xiàn)
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118. 云環(huán)境中跨虛擬機(jī)的Cache側(cè)信道攻擊技術(shù)研究
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119. 多核處理器Cache一致性協(xié)議模型檢驗(yàn)研究與實(shí)現(xiàn)
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120. 多核片上網(wǎng)絡(luò)cache一致性的實(shí)現(xiàn)方法研究
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