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“螢火蟲2號GPU”中像素cache的設(shè)計與實現(xiàn)

發(fā)布時間:2018-07-13 15:51
【摘要】:為了提高"螢火蟲2號GPU"中的指令和數(shù)據(jù)的傳輸速度,設(shè)計了一款連接段操作FOP模塊、2D圖像加速器與幀緩沖區(qū)之間的像素cache.它采用了最近最少使用(LRU)的替換算法和二路組相連的映射方式,成功地接收來自段操作和2D圖像加速器發(fā)送的指令、數(shù)據(jù)以及地址,并且作為高速緩存將數(shù)據(jù)傳遞給存儲管理器(MMU).
[Abstract]:In order to improve the transmission speed of instruction and data in "Firefly 2 GPU", a link segment operation FOP module is designed, which is a pixel cachebetween the 2D image accelerator and the frame buffer. It successfully receives instructions, data, and addresses from segment operations and 2D image accelerators, using the LRU replacement algorithm and a two-way group connected mapping method. The data is passed to the storage manager (MMU) as a cache.
【作者單位】: 西安郵電大學(xué)計算機學(xué)院;西安郵電大學(xué)電子工程學(xué)院;
【基金】:國家自然科學(xué)基金重點資助項目(61136002) 教育部科學(xué)研究計劃重點資助項目(2111180)
【分類號】:TP333

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本文編號:2119949

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