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121. 用于減少遠(yuǎn)程Cache訪問延遲的最后一次寫訪問預(yù)測方法
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122. 片上多核處理器二級Cache結(jié)構(gòu)及資源管理技術(shù)研究
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123. 基于SRAM和STT-RAM的混合指令Cache設(shè)計
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124. 基于流水化和滑動窗口結(jié)構(gòu)的低功耗指令Cache設(shè)計
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125. 嵌入式微處理器中的低功耗Cache技術(shù)研究
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126. 一種基于Cache機制的嵌入式Flash控制器設(shè)計
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127. DSP高效片內(nèi)二級Cache控制器的設(shè)計與實現(xiàn)
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128. 高性能微處理器中緩存器（CACHE）的后端設(shè)計
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129. 高性能DSP一級數(shù)據(jù)Cache控制器的設(shè)計與實現(xiàn)
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130. 微處理器中Cache系統(tǒng)可靠性分析與加固設(shè)計研究
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