【摘要】：隨著工藝尺寸減小,傳統(tǒng)基于SRAM的片上Cache的漏電流功耗成指數(shù)增長,阻礙了片上Cache容量的增加。基于犧牲者Cache的原理,利用SRAM寫速度快,STT-RAM的非易失性、高密度、極低漏電流功耗等特性設(shè)計了一種基于SRAM和STT-RAM的混合型指令Cache。通過實驗證明,該混合型指令Cache與傳統(tǒng)基于SRAM的指令Cache相比,在不增加指令Cache面積的情況下,增加了指令Cache容量,并顯著提高了指令Cache的命中率。
[Abstract]:With the decrease of process size, the leakage current power consumption of traditional Cache based on SRAM increases exponentially, which hinders the increase of on-chip Cache capacity. Based on the principle of victim Cache, a hybrid instruction Cache. based on SRAM and STT-RAM is designed based on the characteristics of SRAM writing speed and STT-RAM, such as non-volatile, high density and extremely low leakage current consumption. Experimental results show that compared with the traditional instruction Cache based on SRAM, the hybrid instruction Cache increases the instruction Cache capacity without increasing the instruction Cache area, and improves the hit ratio of the instruction Cache significantly.
【作者單位】： 西北工業(yè)大學(xué)計算機學(xué)院;
【基金】：國家自然科學(xué)基金(No.60773223,No.61003037,No.60736012,No.61173047) 西北工業(yè)大學(xué)基礎(chǔ)研究基金(No.JC20110224,No.JC201212)
【分類號】：TP333

【參考文獻(xiàn)】

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本文編號：2244556