10GSPS任意波形合成模塊邏輯設(shè)計(jì)
【文章頁(yè)數(shù)】:72 頁(yè)
【學(xué)位級(jí)別】:碩士
【部分圖文】:
圖2-3DDR3SDRAM讀操作時(shí)序圖
以準(zhǔn)確地定位到所找尋的存儲(chǔ)位置。本項(xiàng)目選用的DDR3SDRAM是內(nèi)部配置為8BankDRAM的高速動(dòng)態(tài)隨機(jī)存取存儲(chǔ)器。DDR3SDRAM使用8n預(yù)取架構(gòu)來(lái)實(shí)現(xiàn)高速操作。對(duì)DDR3SDRAM的讀寫操作是突發(fā)傳輸?shù),突發(fā)(Burst)是指在同一行相鄰的存儲(chǔ)單元連續(xù)進(jìn)行數(shù)據(jù)訪問(wèn),連續(xù)訪....
圖2-5基于指令架構(gòu)的任意波形發(fā)生器原理框圖
電子科技大學(xué)碩士學(xué)位論文18能再進(jìn)行簡(jiǎn)單的介紹。DMA控制模塊將接收到的DMA命令解析為波形數(shù)據(jù)讀取控制命令,然后把它發(fā)給存儲(chǔ)器控制模塊。根據(jù)控制命令中包含的信息,對(duì)存儲(chǔ)器的讀寫過(guò)程進(jìn)行控制,將對(duì)應(yīng)地址中的波形數(shù)據(jù)讀取出來(lái)。讀出來(lái)的數(shù)據(jù)并不能直接發(fā)送給DAC直接進(jìn)行數(shù)模轉(zhuǎn)換,需要....
圖2-6FIFO仿真
中full信號(hào)有效時(shí),表明FIFO已經(jīng)滿了,不能再往FIFO中寫入數(shù)據(jù),否則會(huì)發(fā)生溢出;當(dāng)FIFO中full信號(hào)有效時(shí),表明此時(shí)FIFO中的數(shù)據(jù)已經(jīng)被讀空,不能再繼續(xù)進(jìn)行讀數(shù)據(jù)的操作。與空滿信號(hào)功能相似的還有預(yù)空和預(yù)滿信號(hào),分別是almost_full....
圖2-7AD9164功能框圖
電子科技大學(xué)碩士學(xué)位論文208時(shí),只需要對(duì)對(duì)應(yīng)的寄存器進(jìn)行配置,根據(jù)數(shù)據(jù)的映射規(guī)則對(duì)輸入的數(shù)據(jù)進(jìn)行格式上的調(diào)整即可,應(yīng)用十分靈活。圖2-7AD9164功能框圖AD9164內(nèi)部的寄存器可以通過(guò)SPI接口進(jìn)行配置。當(dāng)DAC的采樣率低于200MSPS,通常選用CMOS(Compleme....
本文編號(hào):3909309
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