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141. 基于ARM7TDMI的Cache的設(shè)計(jì)與驗(yàn)證
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142. 面向共享Cache多核處理器的數(shù)據(jù)庫查詢執(zhí)行優(yōu)化技術(shù)研究
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143. 微處理器中Cache漏流功耗的體系結(jié)構(gòu)級優(yōu)化技術(shù)研究
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144. 眾核處理器中動態(tài)可重構(gòu)Cache一致性協(xié)議的研究與實(shí)現(xiàn)
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145. CC-NUMA系統(tǒng)中Cache一致性協(xié)議模擬驗(yàn)證方法研究
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146. 一種針對Cache Tag單錯(cuò)及鄰位雙錯(cuò)的低開銷容錯(cuò)方法
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147. 基于多總線可重構(gòu)處理器的L2Cache的設(shè)計(jì)與驗(yàn)證
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148. 面向大規(guī)模分布式共享內(nèi)存系統(tǒng)的Cache一致性協(xié)議研究和實(shí)現(xiàn)
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149. 65nm L1 D-Cache中DCA的全定制設(shè)計(jì)與實(shí)現(xiàn)
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150. FT-異構(gòu)多核DSP高速高效性能二級Cache/RAM的設(shè)計(jì)優(yōu)化與驗(yàn)證
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