信道編譯碼算法研究與實(shí)現(xiàn)
本文關(guān)鍵詞:信道編譯碼算法研究與實(shí)現(xiàn)
【摘要】:通信系統(tǒng)的信號在傳播過程中,會受到乘性和加性噪聲的干擾而發(fā)生形變,使得接收機(jī)的檢測出現(xiàn)錯(cuò)誤。在發(fā)送端對信號進(jìn)行編碼以增加冗余度,在接收端則采用譯碼方法進(jìn)行信號接收的方法可以有效降低信號接收的誤碼率,保證系統(tǒng)信號傳輸?shù)目煽啃浴1疚膶S碼的編譯碼方法、卷積碼的編譯碼方法、RS碼和卷積碼的級聯(lián)進(jìn)行了研究與實(shí)現(xiàn),主要工作如下:一、提出了一種RS碼的改進(jìn)譯碼算法。在介紹RS碼編碼原理與譯碼算法的基礎(chǔ)上,對現(xiàn)有Chase 2譯碼方法進(jìn)行了改進(jìn),減少了原有算法中試探序列集合中元素?cái)?shù)目;仿真表明,改進(jìn)后的算法在性能稍有損失的基礎(chǔ)上極大降低了計(jì)算復(fù)雜度。此外,論文還對RS碼在加性高斯白噪聲信道、實(shí)際測量的可見光通信(VLC)信道下,仿真了在不同冗余度條件下的誤碼率性能。二、分別在理想高斯白噪聲信道以及實(shí)測VLC信道條件下,仿真了卷積碼編碼約束長度和譯碼回溯深度這兩個(gè)參數(shù)的不同取值對誤碼率性能的影響,此外在理想信道下仿真了Turbo碼在不同譯碼算法和不同迭代次數(shù)時(shí)的誤碼率性能,并與卷積碼的性能進(jìn)行了仿真對比。三、仿真分析了可見光信道下RS碼與卷積碼級聯(lián)編碼的誤碼率性能。在加性高斯白噪聲信道下對RS碼和卷積碼級聯(lián)編碼系統(tǒng),仿真了在RS碼的不同最大糾錯(cuò)符號數(shù)、卷積碼不同約束長度下的系統(tǒng)誤碼率性能。四、對RS碼、卷積碼以及它們的串行級聯(lián)編碼,編寫了Verilog HDL代碼,并完成了硬件實(shí)現(xiàn)。論文描述了物理實(shí)現(xiàn)的平臺與流程,分析了各模塊的時(shí)序與資源消耗,給出了硬件實(shí)現(xiàn)方案。
【關(guān)鍵詞】:VLC RS碼 卷積碼
【學(xué)位授予單位】:東南大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2016
【分類號】:TN911.22
【目錄】:
- 摘要5-6
- Abstract6-13
- 第1章 緒論13-17
- 1.1 研究背景13-14
- 1.2 國內(nèi)外研究現(xiàn)狀14-15
- 1.3 論文研究內(nèi)容及意義15-16
- 1.4 論文組織結(jié)構(gòu)16-17
- 第2章 RS碼譯碼算法改進(jìn)17-33
- 2.1 引言17-19
- 2.2 發(fā)送端RS碼編碼19-21
- 2.3 接收端RS碼譯碼21-29
- 2.3.1 RS伴隨式譯碼算法21-27
- 2.3.2 RS軟判決譯碼算法27-29
- 2.4 改進(jìn)的RS譯碼算法29-31
- 2.5 本章小結(jié)31-33
- 第3章 卷積碼譯碼性能仿真33-49
- 3.1 引言33-35
- 3.2 卷積碼系統(tǒng)模型35-40
- 3.2.1 發(fā)送端卷積編碼35-37
- 3.2.2 接收端卷積譯碼37-40
- 3.3 卷積碼性能仿真分析40-43
- 3.4 Turbo碼系統(tǒng)模型43-47
- 3.4.1 Turbo碼編碼譯碼模型43-44
- 3.4.2 Turbo碼性能仿真44-47
- 3.5 本章小結(jié)47-49
- 第4章 信道級聯(lián)編碼性能分析49-57
- 4.1 引言49
- 4.2 串行級聯(lián)與交織49-52
- 4.3 串行級聯(lián)編碼性能仿真52-56
- 4.4 小結(jié)56-57
- 第5章 信道編碼的實(shí)現(xiàn)57-71
- 5.1 引言57
- 5.2 FPGA開發(fā)平臺搭建及設(shè)計(jì)流程57-59
- 5.3 信道編碼譯碼模塊實(shí)現(xiàn)59-68
- 5.3.1 RS碼實(shí)現(xiàn)59-64
- 5.3.2 卷積碼實(shí)現(xiàn)64-68
- 5.4 級聯(lián)實(shí)現(xiàn)68-69
- 5.5 本章小結(jié)69-71
- 第6章 總結(jié)與展望71-73
- 參考文獻(xiàn)73-77
- 致謝77-79
- 作者簡介79
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,本文編號:710863
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