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具有高速存儲的高幀頻高灰度圖像編解碼系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

發(fā)布時間:2020-06-30 15:45
【摘要】:隨著紅外半實(shí)物仿真技術(shù)的快速發(fā)展,紅外半實(shí)物仿真系統(tǒng)對紅外圖像的分辨率、幀頻和灰度等指標(biāo)提出了更高的要求。因此,作為半實(shí)物仿真系統(tǒng)中關(guān)鍵設(shè)備之一的紅外目標(biāo)模擬器需要具備高幀頻高灰度的圖像編解碼能力。本文根據(jù)紅外目標(biāo)模擬器的需求,設(shè)計(jì)了一套具有高速存儲的高幀頻高灰度圖像編解碼系統(tǒng),并基于此系統(tǒng)實(shí)現(xiàn)了圖像編解碼算法。首先根據(jù)系統(tǒng)的功能和指標(biāo)需求,以Xilinx Kintex-7系列FPGA作為處理器,DDR3 SDRAM作為高速存儲器,HDMI和DVI作為數(shù)據(jù)傳輸接口,對系統(tǒng)的總體架構(gòu)進(jìn)行設(shè)計(jì);在此基礎(chǔ)上,對相關(guān)芯片選型以及進(jìn)行原理圖設(shè)計(jì),同時根據(jù)原理圖完成PCB布局布線;最終完成系統(tǒng)硬件平臺的搭建。在系統(tǒng)硬件平臺上,利用Verilog硬件描述語言進(jìn)行了相關(guān)時序邏輯設(shè)計(jì)。利用MIG核實(shí)現(xiàn)DDR3 SDRAM存儲邏輯設(shè)計(jì),并實(shí)現(xiàn)HDMI接口邏輯設(shè)計(jì),最后實(shí)現(xiàn)圖像編解碼算法和圖像降幀的邏輯設(shè)計(jì)。在本文的最后,對系統(tǒng)整體功能進(jìn)行驗(yàn)證,驗(yàn)證過程分為物理層和應(yīng)用層兩個部分。物理層對硬件的接口,存儲等功能進(jìn)行驗(yàn)證;應(yīng)用層對圖像編解碼算法和圖像降幀等功能進(jìn)行驗(yàn)證。本文設(shè)計(jì)的系統(tǒng)最大傳輸像素時鐘可達(dá)300MHz,可以滿足高幀頻高灰度圖像的編解碼處理。
【學(xué)位授予單位】:西安電子科技大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2019
【分類號】:TN919.81
【圖文】:

架構(gòu)圖,半實(shí)物仿真系統(tǒng),架構(gòu)


半實(shí)物仿真系統(tǒng)架構(gòu)

電路圖,系統(tǒng)復(fù)位,電路,時鐘


過按鍵來控制 PROG_B 管腳的電平即可控制系統(tǒng)的復(fù)位,當(dāng)按鍵被按下時,PROG_B被拉低,系統(tǒng)復(fù)位,具體電路如圖 3.1 所示。圖3.1 系統(tǒng)復(fù)位電路2) 時鐘電路系統(tǒng)的時鐘有全局時鐘、DDR3 工作時鐘、配置時鐘,其中全局時鐘和配置時鐘為單端時鐘,分別為 50MHz 和 66Mhz,由有源晶振提供,DDR3 的工作時鐘為差分時鐘,由差分晶振 SIT9102 來提供[22]。系統(tǒng)的時鐘電路如 3.2 圖所示。

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5 程W

本文編號:2735499


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