發(fā)布時間：2020-04-02 13:27

【摘要】：在雷達(dá)系統(tǒng)中,高速AD/DA采集回放是射頻前端和信號處理之間橋梁。近年來隨著雷達(dá)系統(tǒng)的發(fā)展,有源相控陣、MIMO陣列等技術(shù)成為其趨勢。陣元數(shù)量的增加、波形帶寬的提升,對信號采樣技術(shù)提出了更高的要求。AD采集板逐漸向多通道,高帶寬方向發(fā)展。隨著AD轉(zhuǎn)換器的采樣率和每秒產(chǎn)生的數(shù)據(jù)量大幅度提升。為降低傳統(tǒng)AD轉(zhuǎn)換器高速高位寬并行數(shù)據(jù)傳輸?shù)臅r序控制及布線難度,各大集成電路廠商開始使用JESD204B接口協(xié)議作為高速轉(zhuǎn)換器的首選接口標(biāo)準(zhǔn)。采用編碼后的高速串行數(shù)據(jù)來替代原始并行采樣結(jié)果。數(shù)據(jù)傳輸速率也從傳統(tǒng)LVDS DDR接口500Mbps躍升至CML接口12.5Gbps。這也使得此類轉(zhuǎn)換器的數(shù)�；旌想娐吩O(shè)計、片間同步設(shè)計、信號完整性考量與傳統(tǒng)轉(zhuǎn)換器截然不同。本文主要研究的內(nèi)容有:1.研究了超高速數(shù)�；旌想娐吩O(shè)計方法,包括布局布線、電源電路設(shè)計、信號完整性分析。并根據(jù)文中內(nèi)容科學(xué)合理的設(shè)計采樣率高達(dá)2.5GSPS,12位8通道超高速同步AD采集電路,完成硬件平臺搭建。2.分析JESD204B接口協(xié)議,在FPGA邏輯中實現(xiàn)了該接口設(shè)計。完成串行接口速率高達(dá)6.5Gbps的高速的JESD204B接口。并針對JESD204B協(xié)議內(nèi)容在多種應(yīng)用場景下提出了不同結(jié)構(gòu)的同步時鐘網(wǎng)絡(luò)。在軟件中構(gòu)建了完整的多通道同步采集JESD204B接口工程。3.研究了通道一致性補償。分別討論了窄帶和寬帶兩種情況下的補償方法。通過“硬(同步時鐘網(wǎng)絡(luò)設(shè)計)”“軟(相位、時延補償算法)”結(jié)合的方式實現(xiàn)高性能高速多通道同步采樣技術(shù)。4.分析AD轉(zhuǎn)換器誤差產(chǎn)生原因,設(shè)計合理的轉(zhuǎn)換器動態(tài)參數(shù)測定方法。對本文設(shè)計的高速同步采集電路性能進(jìn)行詳細(xì)的測試。同時討論了電路設(shè)計對同步性的影響,測定采樣同步性能,為以后同類設(shè)計提供參考。
【圖文】：

機載有源平面相控陣天線

圖 1-2 AN/TPY-2 雷達(dá)組件及其供電設(shè)配 技術(shù)已不僅僅局限于龐大的地面雷達(dá)[7]，越來越多的機載雷達(dá)甚至個方向發(fā)展。主動雷達(dá)是第四代空空導(dǎo)彈的特點，，是現(xiàn)代導(dǎo)引頭技
【學(xué)位授予單位】：西安電子科技大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2019
【分類號】：TN957.51

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本文編號：2612012