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基于FPGA的HDMI多模式顯示模塊設(shè)計

發(fā)布時間:2019-10-17 14:58
【摘要】:通過SOPC進行視頻信號處理是目前研究的熱點。針對此類系統(tǒng)的顯示模塊,提出一種基于FPGA的HDMI多模式顯示模塊設(shè)計方案。首先對HDMI的驅(qū)動時序進行分析,設(shè)計驅(qū)動信號生成電路,然后根據(jù)配置參數(shù),將多路視頻進行多級ALPHA混合,實現(xiàn)了通過HDMI輸出與顯示多路視頻,并且每路視頻的位置與透明度可設(shè)置。為保證視頻的實時性,對較為復(fù)雜的計算過程采用流水線設(shè)計方法提升速度。模塊以Verilog HDL的形式進行編寫,具有較強的通用性。
【作者單位】: 貴州大學(xué)大數(shù)據(jù)與信息工程學(xué)院;
【基金】:國家科技支撐計劃(2015BAK28B02)
【分類號】:TN873

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本文編號:2550612

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