【摘要】：設計了一個5.156 25GHz低抖動、低雜散的亞采樣鎖相環(huán),使用正交壓控振蕩器產(chǎn)生4路等相位間隔時鐘。分析了電荷泵的雜散理論,使用差分緩沖器和互補開關對實現(xiàn)了低雜散。使用Dummy采樣器和隔斷緩沖器,進一步減小了壓控振蕩器對雜散的惡化。該亞采樣鎖相環(huán)在40nm CMOS工藝下實現(xiàn),在1.1 V的供電電壓下,功耗為7.55 mW;在156.25 MHz頻偏處,雜散為-81.66dBc;亞采樣鎖相環(huán)輸出時鐘的相位噪聲在10kHz~100 MHz區(qū)間內(nèi)積分,得到均方根抖動為0.26ps。
[Abstract]:A 5.156 25GHz low jitter, low spurious subsampling PLL is designed. The quadrature voltage controlled oscillator is used to generate four equal phase interval clocks. The spurious theory of charge pump is analyzed, and the low spurious property is realized by using differential buffer and complementary switch. The Dummy sampler and the buffer are used to further reduce the spurious deterioration of the voltage controlled oscillator (VCO). The sub-sampling phase-locked loop is realized in 40nm CMOS process. At 1.1V power supply voltage, the power consumption is 7.55 mW; at 156.25 MHz frequency offset, and the spurious is-81.66 dBC. The phase noise of the subsampling PLL output clock is integrated in the 10kHz~100 MHz interval, and the RMS jitter is 0.26ps.
【作者單位】： 中國科學技術大學微納電子系統(tǒng)集成研究中心;
【分類號】：TN911.8

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