本文選題：集成電路 + 脈沖壓縮��； 參考：《制導(dǎo)與引信》2016年04期

【摘要】：為滿足單脈沖雷達(dá)導(dǎo)引頭的國產(chǎn)化與小型化需求,基于國內(nèi)自主微電子工藝線研制了一款雷達(dá)信號處理專用集成電路(ASIC)。該芯片集成了和差轉(zhuǎn)換、數(shù)字下變頻、載體速度補(bǔ)償、脈沖壓縮等電路。在外接SRAM的情況下,芯片還可以完成動目標(biāo)檢測運(yùn)算。通過片上集成的EMIF與SPI接口,可以完成對芯片功能參數(shù)的配置,進(jìn)而適應(yīng)不同的應(yīng)用環(huán)境。經(jīng)過對芯片的功能測試,在100 MHz輸入時鐘下,該芯片的功能與設(shè)計(jì)需求相符。相對于基于FPGA平臺的雷達(dá)信號處理電路,該電路具有更小的體積與更低的功耗,為彈載雷達(dá)信號處理提供了新的解決方案。
[Abstract]:In order to meet the requirement of localization and miniaturization of single - pulse radar seeker , a special integrated circuit ( ASIC ) for radar signal processing has been developed based on the domestic self - contained microelectronic process line . The chip integrates with differential conversion , digital down - conversion , carrier speed compensation , pulse compression and so on . In the case of external SRAM , it can complete the configuration of chip functional parameters . It can also adapt to different application environments . With the function test of the chip , the circuit has smaller volume and lower power consumption compared with the radar signal processing circuit based on FPGA platform . It provides a new solution for signal processing of missile - borne radar .
【作者單位】： 中國電子科技集團(tuán)公司第二十四研究所;
【基金】：國家863計(jì)劃項(xiàng)目(2012AA012303)
【分類號】：TN957.51

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