本文選題：戰(zhàn)術(shù)數(shù)據(jù)鏈 + FPGA�。� 參考：《火力與指揮控制》2017年10期

【摘要】：為了適應(yīng)戰(zhàn)術(shù)數(shù)據(jù)鏈向小型化、單兵化的發(fā)展趨勢(shì),提出了一種基于Zynq的高性能戰(zhàn)術(shù)數(shù)據(jù)鏈端機(jī)的設(shè)計(jì)方案。給出了設(shè)計(jì)流程和硬件設(shè)計(jì)原理圖。實(shí)現(xiàn)了端機(jī)的RS編譯碼、CCSK軟擴(kuò)頻、CCSK解擴(kuò)解調(diào)等子模塊及PS、PL之間的通信。在vivado IDE、SDK環(huán)境下選擇Zynq xc7z035 FPGA芯片進(jìn)行系統(tǒng)級(jí)綜合、仿真和驗(yàn)證。結(jié)果表明,與傳統(tǒng)方法相比,該方案簡(jiǎn)化了端機(jī)的實(shí)現(xiàn)難度、提高了集成度、幀數(shù)據(jù)處理速度可達(dá)到ms級(jí),硬件成品適合工作在高動(dòng)態(tài)、多節(jié)點(diǎn)的場(chǎng)合。
[Abstract]:In order to meet the trend of miniaturization and individualization of tactical data link, a design scheme of high performance tactical data link terminal based on Zynq is proposed. The design flow and hardware schematic diagram are given. The communication between RS code and decode CCSK soft spread spectrum (CCSK) despreading demodulation and PSPPL is realized. In the environment of vivado IDEN SDK, Zynq xc7z035 FPGA chip is selected for system level synthesis, simulation and verification. The results show that compared with the traditional method, the scheme simplifies the implementation of the end machine, improves the integration, and the frame data processing speed can reach Ms level. The hardware product is suitable for working in high dynamic and multi-node situations.
【作者單位】： 西安郵電大學(xué);西安電子科技大學(xué);
【基金】：陜西省自然科學(xué)基金資助項(xiàng)目(2111JM8083)
【分類(lèi)號(hào)】：TN919.2

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