本文選題：片上網(wǎng)絡　切入點：偏轉(zhuǎn)路由　出處：《計算機工程》2017年02期 　論文類型：期刊論文

【摘要】：片上網(wǎng)絡通常使用輸入輸出緩存或交叉開關緩存存儲微片以提高路由器性能,導致大量消耗片上資源并顯著增加功耗。無緩存路由器被提出用于解決該問題,但存在低效率的偏轉(zhuǎn),不適用于中、高負載的網(wǎng)絡。為此,設計一種基于方向向量路由策略的低偏轉(zhuǎn)率微緩存路由器。采用一個旁路寄存器和一個回環(huán)寄存器的設計,通過二分圖最大匹配調(diào)度算法優(yōu)化微片路由。在Xilinx Vivado上的仿真結(jié)果表明,該路由器的性能與RIDER路由器相當,但寄存器使用減少55%,并且在高負載網(wǎng)絡中性能優(yōu)于CHIPPER,Min BD和RIDER路由器。
[Abstract]:On-chip networks usually use input / output buffers or cross-switch buffers to improve router performance, resulting in significant consumption of on-chip resources and significantly increased power consumption. Buffer free routers are proposed to solve this problem. But there is low efficiency deflection, which is not suitable for medium and high load network. Therefore, a low deflection rate micro-cache router based on directional vector routing strategy is designed, which adopts a bypass register and a loop register. The simulation results on Xilinx Vivado show that the performance of the router is comparable to that of the RIDER router, but the register usage is reduced by 55%, and the performance of the router is better than that of CHIPPER-Min BD and RIDER routers in high-load networks.
【作者單位】： 國家數(shù)字交換系統(tǒng)工程技術研究中心;
【基金】：國家“863”計劃重大項目“5G大規(guī)模協(xié)作無線傳輸關鍵技術研發(fā)”(2014AA01A704) 國家自然科學基金“網(wǎng)絡空間擬態(tài)安全異構(gòu)冗余機制研究”(61572520)
【分類號】：TN41;TN915.05

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本文編號：1637800