發(fā)布時間：2017-11-06 05:36

  本文關鍵詞：基于環(huán)形壓控振蕩器的電荷泵鎖相環(huán)設計

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【摘要】：在闡述了電荷泵鎖相環(huán)的工作原理、分析和設計方法的基礎上,結(jié)合環(huán)路穩(wěn)定性和相位噪聲兩方面因素對鎖相環(huán)電路進行了建模及分析。介紹了鎖相環(huán)的系統(tǒng)級參數(shù)設計到電路設計的完整流程。首先利用Verilog-A語言建立了一個考慮各電路模塊主要非理想因素的較為精確的鎖相環(huán)行為級模型,然后進行單元電路的設計,考慮了溫度變化對環(huán)形壓控振蕩器和鎖相環(huán)系統(tǒng)的影響并分別進行了溫度補償。采用Cadence公司的Spectre-RF系列軟件進行仿真,最后得到的鎖相環(huán)輸出頻率范圍為150 MHz~350 MHz,相位噪聲為-113.8 dBc/Hz(振蕩頻率為240 MHz,頻偏為2 MHz時),均方根抖動為3.65 ps,鎖定時間小于3μs,可為高速數(shù)字電路產(chǎn)生低抖動的片上時鐘信號。
【作者單位】： 杭州電子科技大學電子信息學院;
【分類號】：TN911.8
【正文快照】： 0 引言 鎖相環(huán)(Phase Lock Loop,PLL)具有數(shù)據(jù)時鐘恢復、消除時鐘抖動、頻率合成等多種用途。自從1965年PLL集成電路問世以來,PLL設計技術越來越成熟,從分立器件到集成電路,從雙極型工藝到CMOS技術[1]。當前PLL的研究熱點主要集中在低相位噪聲、低雜散、高集成度、低電壓、低

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本文編號：1147610