本文關(guān)鍵詞：基于因子圖的模擬迭代譯碼技術(shù)

  更多相關(guān)文章： 因子圖 電路動態(tài)行為 晶體管失配效應(yīng) 混合行為/結(jié)構(gòu)模型

【摘要】：高性能信道編碼如LDPC,已廣泛應(yīng)用于通信領(lǐng)域,而高性能帶來的高處理復(fù)雜度與處理功耗已成為制約通信系統(tǒng)終端小型化的瓶頸之一。模擬迭代譯碼技術(shù)以其極低的單位信息量處理功耗等特點重新進入研究者視線,為進一步降低譯碼器處理功耗、提高速度提供了一種新的選擇。與數(shù)字譯碼電路對比,目前已實現(xiàn)的模擬譯碼樣品已經(jīng)在功耗效率上展示出顯著提高,并且僅帶來很小的糾錯性能損耗。但是所有這些譯碼器實現(xiàn)僅限于非常短的字組長度,整個研究還處于概率驗證階段,不適合實際應(yīng)用。因此需要在前人研究基礎(chǔ)上構(gòu)建更加合理的譯碼器分布式行為模型。由于實際模擬電路的尺寸比較大,很難在短時間內(nèi)對高復(fù)雜度的解碼器實現(xiàn)獲取電路性能的可靠估計。電路級仿真限制在整體模擬解碼器的子模塊,只有很小的模擬解碼器可以仿真一些選定的解碼配置。缺少更詳細(xì)的系統(tǒng)性能評價,特別是在誤碼率方面,因此需要依靠高層次的仿真模型,同時需要捕獲足夠詳細(xì)的模擬解碼器的主要特征,在降低計算復(fù)雜度的同時,更方便系統(tǒng)級規(guī)范的仿真。在本文中,提出了一種基于和積算法的模擬低密度奇偶校驗(LDPC)譯碼器的混合行為/結(jié)構(gòu)模型,重點考慮晶體管失配效應(yīng)和電路動態(tài)行為兩大實際因素。將晶體管級別參數(shù)和系統(tǒng)級別特性聯(lián)系起來,該模型可用于估算模擬解碼器的系統(tǒng)性能和提供復(fù)雜的解碼電路的優(yōu)化準(zhǔn)則。本文并以(40,16)線性分組碼為例,仿真結(jié)果表明該模型能夠在短時間內(nèi)可靠地預(yù)測系統(tǒng)性能。最后進行了建模驗證,證明該模型達(dá)到預(yù)期目標(biāo)。
【關(guān)鍵詞】：因子圖 電路動態(tài)行為 晶體管失配效應(yīng) 混合行為/結(jié)構(gòu)模型
【學(xué)位授予單位】：北京理工大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2016
【分類號】：TN911.22
【目錄】：

• 摘要5-6
• Abstract6-10
• 第1章 緒論10-15
• 1.1 本論文研究的目的和意義10
• 1.2 國內(nèi)外研究現(xiàn)狀及發(fā)展趨勢10-13
• 1.3 本文研究內(nèi)容與安排13-15
• 第2章 模擬迭代譯碼技術(shù)15-38
• 2.1 因子圖15-21
• 2.1.1 因子圖的定義15-16
• 2.1.2 因子圖中的局部函數(shù)16-21
• 2.2 和積算法21-23
• 2.3 概率門電路的實現(xiàn)23-29
• 2.3.1 信號加法26-27
• 2.3.2 核心電路——矩陣乘法電路27-28
• 2.3.3 歸一化概率函數(shù)電路28-29
• 2.4 軟邏輯門電路實現(xiàn)29-33
• 2.4.1 軟邏輯門網(wǎng)格表示30-31
• 2.4.2 軟異或門電路31-32
• 2.4.3 等效門電路32-33
• 2.5 基本電路模塊之間連接33-36
• 2.5.1 電流鏡33-34
• 2.5.2 電流形式連接問題34-36
• 2.6 本章小結(jié)36-38
• 第3章 模擬迭代譯碼電路混合行為模型建模38-63
• 3.1 模擬譯碼電路動態(tài)行為分析39-47
• 3.1.1 基于概率計算的信號處理算法動態(tài)行為仿真模型設(shè)計39-42
• 3.1.2 基于概率計算的信號處理算法動態(tài)行為仿真模型驗證42-43
• 3.1.3 相同延時的仿真結(jié)果43-45
• 3.1.4 隨機延時仿真結(jié)果45-47
• 3.2 模擬譯碼電路模型處理延時分析47-48
• 3.3 晶體管失配效應(yīng)48-57
• 3.3.1 晶體管電路輸入電壓與對數(shù)似然陳述49-51
• 3.3.2 單晶體管不匹配51-52
• 3.3.3 基本矩陣晶體管失配效應(yīng)52-53
• 3.3.4 計算和建模整個和積模塊電路的失配效應(yīng)53-57
• 3.4 模擬迭代譯碼電路的混合行為/結(jié)構(gòu)模型57-58
• 3.5 仿真結(jié)果分析58-61
• 3.6 本章小結(jié)61-63
• 第4章 譯碼器行為模型驗證平臺設(shè)計63-73
• 4.1 LDPC碼概率計算模擬譯碼器測試原理63-67
• 4.2 測試內(nèi)容67-69
• 4.2.1 電路時序68
• 4.2.2 測試方案68-69
• 4.3 測試結(jié)果與分析69-72
• 4.3.1 建立時間69-70
• 4.3.2 誤碼率70-72
• 4.4 本章小結(jié)72-73
• 結(jié)論73-75
• 參考文獻75-80
• 攻讀學(xué)位期間發(fā)表論文與研究成果清單80-81
• 致謝81

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本文編號：1061788