【摘要】：異構(gòu)眾核架構(gòu)具有超高的性能功耗比,已成為超級(jí)計(jì)算機(jī)體系結(jié)構(gòu)的重要發(fā)展方向.但眾核系統(tǒng)更為復(fù)雜的并行層次和存儲(chǔ)層次,給編程和優(yōu)化帶來了極大的挑戰(zhàn).因此,研究面向眾核系統(tǒng)的并行編程技術(shù),對(duì)于降低國產(chǎn)眾核系統(tǒng)并行應(yīng)用的編程難度、提升并行程序的性能都具有重要的意義.提出統(tǒng)一架構(gòu)的多模式并行編程模型,包括異構(gòu)融合的加速運(yùn)算模型和按同構(gòu)方式編程的自主運(yùn)算模型,根據(jù)編程模型設(shè)計(jì)了Parallel C語言,能夠有效地描述國產(chǎn)眾核系統(tǒng)的異構(gòu)并行性.與其他眾核系統(tǒng)上MPI+X的使用模式相比,編程和系統(tǒng)優(yōu)化都具有全局視角,在多級(jí)局部性描述、單邊消息、兼容已有多核應(yīng)用等方面具有特色;基于Open64構(gòu)建了Parallel C編譯系統(tǒng),全面支持加速運(yùn)算模型和自主運(yùn)算模型,提出并實(shí)現(xiàn)了數(shù)據(jù)布局與自動(dòng)DMA、編譯指導(dǎo)的線程代理和拓?fù)湮恢酶兄募贤ㄐ诺葍?yōu)化.Micro Benchmark和實(shí)際應(yīng)用在神威太湖之光計(jì)算機(jī)系統(tǒng)上的測試數(shù)據(jù)結(jié)果表明:Parallel C語言和編譯系統(tǒng)具有良好的性能和可擴(kuò)展性,能夠有效支撐大型應(yīng)用.
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圖片說明： 766JournalofSoftware軟件學(xué)報(bào)Vol.28,No.4,April2017開發(fā)硬件數(shù)百萬到10億量級(jí)規(guī)模處理器核心的并發(fā)度,能表示多種類型、不同層次的并行性;(2)要能有效支持系統(tǒng)復(fù)雜的存儲(chǔ)結(jié)構(gòu)、局部性描述和高效的數(shù)據(jù)移動(dòng).2國產(chǎn)異構(gòu)眾核系統(tǒng)面向高性能計(jì)算的眾核處理器包括Intel的MIC[17]、Nvidia和AMD的GPU[18,19]、Godson-T[20]、申威眾核處理器等.申威眾核處理器的結(jié)構(gòu)如圖1所示[21],每顆處理器包含4個(gè)core-groups(CGs),每個(gè)CG包含1個(gè)MPE(managementprocessingelement,簡稱主核)、1個(gè)8×8的computingprocessingelement(CPE,簡稱從核)cluster和1個(gè)memorycontroller(MC),4個(gè)CG通過片上網(wǎng)絡(luò)(NoC)互連,處理器通過Systeminterface(SI)連接外部設(shè)備.申威眾核處理器的主核和從核共享memory,從核采用輕量級(jí)的核心設(shè)計(jì),配備由軟件管理的高速存儲(chǔ)器SPM(scratchpadmemory)[22],支持通過DMA(directmemoryaccess)方式在memory和SPM間批量傳輸數(shù)據(jù).Fig.1ArchitectureofthenewSunwayprocessor圖1申威眾核處理器結(jié)構(gòu)基于申威眾核處理器的異構(gòu)眾核系統(tǒng)架構(gòu)如圖2所示,運(yùn)算系統(tǒng)采用申威眾核處理器構(gòu)建,通過中心交換網(wǎng)絡(luò)和管理網(wǎng)絡(luò)與存儲(chǔ)系統(tǒng)和管理系統(tǒng)連接,系統(tǒng)的登陸界面和存儲(chǔ)空間采用單一映像組織,為用戶提供統(tǒng)一的視圖.國產(chǎn)異構(gòu)眾核系統(tǒng)運(yùn)算系統(tǒng)存儲(chǔ)系統(tǒng)中心交換網(wǎng)絡(luò)(InfiniBand)管理網(wǎng)(GigaNet)管理系統(tǒng)遠(yuǎn)程網(wǎng)絡(luò)用戶終端Fig.2Architectureofdomesticheterogenousmany-coresystem圖2異構(gòu)眾核系統(tǒng)結(jié)構(gòu)
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圖片說明： 何王全等:面向國產(chǎn)異構(gòu)眾核系統(tǒng)的ParallelC語言設(shè)計(jì)與實(shí)現(xiàn)7673面向異構(gòu)眾核系統(tǒng)的并行編程模型眾核系統(tǒng)的顯著特征是計(jì)算資源眾多、并行層次比多核系統(tǒng)更為復(fù)雜,編程和優(yōu)化的難度也比多核系統(tǒng)大,需要在并行編程模型和語言設(shè)計(jì)上有所突破,滿足不同層次人員的編程需要.針對(duì)申威眾核處理器異構(gòu)并行、共享主存的架構(gòu)特征,我們提出了多模式并行編程模型,包括異構(gòu)融合的加速運(yùn)算模型和按同構(gòu)方式編程的自主運(yùn)算模型,并且在此基礎(chǔ)上設(shè)計(jì)實(shí)現(xiàn)了統(tǒng)一架構(gòu)的并行編程語言ParallelC.異構(gòu)融合的加速運(yùn)算模型如圖3所示,該模型有如下特點(diǎn).1)ParallelC的進(jìn)程(類似MPI進(jìn)程)運(yùn)行于眾核處理器的主核,負(fù)責(zé)管理控制、通信、I/O等復(fù)雜的操作,大量的加速線程運(yùn)行于眾核處理器的從核,負(fù)責(zé)加速核心計(jì)算代碼;2)進(jìn)程和加速線程共享memory,與x86+GPU或x86+MIC上的編程模型相比,無需在兩種存儲(chǔ)器之間通過PCI-E或其他接口進(jìn)行數(shù)據(jù)傳輸,編程方便、效率也更高;3)在節(jié)點(diǎn)內(nèi),可以通過共享擴(kuò)展描述,方便地實(shí)現(xiàn)共享編程,提高節(jié)點(diǎn)內(nèi)數(shù)據(jù)交換的效率;4)在進(jìn)程之間,通過消息進(jìn)行數(shù)據(jù)交換,并支持多級(jí)局部性描述,使ParallelC可高效擴(kuò)充到大規(guī)模環(huán)境.該模型支持消息、共享和加速運(yùn)算的任意組合,可有效描述異構(gòu)系統(tǒng)多維度的并行,解決MPI+X模型要求用戶掌握2~3種編程語言的問題.Fig.3Acceleratedcomputingmodel圖3異構(gòu)融合的加速運(yùn)算模型設(shè)計(jì)按同構(gòu)方式編程的自主運(yùn)算模型有兩個(gè)目的.一是讓程序員以熟悉的多核方式編程,最大限度地屏蔽異構(gòu)眾核系統(tǒng)的復(fù)雜性;二是兼容ParallelC在多核環(huán)境下的遺產(chǎn)代碼.自主運(yùn)算模型如圖4所示,程序員只需按傳統(tǒng)多核方式進(jìn)行編程,由編譯系統(tǒng)將同構(gòu)、單維度并行描述映射到異構(gòu)、多維度并行的體系結(jié)構(gòu),ParallelC進(jìn)程運(yùn)行于從核上,通信、I/O、系統(tǒng)調(diào)用等復(fù)雜的功能則由主?
【作者單位】： 江南計(jì)算技術(shù)研究所;
【基金】：國家重點(diǎn)基礎(chǔ)研究發(fā)展計(jì)劃(973)(2016YFB0200502) 國家高技術(shù)研究發(fā)展計(jì)劃(863)(2012AA010903,2015AA 01A301) 計(jì)算機(jī)體系結(jié)構(gòu)國家重點(diǎn)實(shí)驗(yàn)室基金(CARCH201403)~~
【分類號(hào)】：TP312.1

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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本文編號(hào)：2513060