本文關鍵詞：一種兼容MCS-51指令集的單片機內核的設計與驗證

  更多相關文章： 51內核 流水線 數(shù)據(jù)沖突 功能驗證 單片機

【摘要】：本文重點設計了一款兼容MCS-51指令集系統(tǒng)的51內核，，它包括微處理器和中斷系統(tǒng)兩部分。本設計在功能上可完成111條指令的邏輯功能以及22個中斷源的中斷仲裁。 在微處理器設計方面，將CISC指令集系統(tǒng)微處理器設計技術與RISC系統(tǒng)微處理器架構設計技術相融合，提出了一種多周期指令和流水線技術相結合的方法，并設計了一款流水線實現(xiàn)的CISC指令集架構的微處理器。本設計分為三級流水線，包括取指級、譯碼級和執(zhí)行級，取指級和譯碼級完成將指令碼取出并對其譯碼的功能，執(zhí)行級在一個時鐘周期內完成取操作數(shù)、運算和寫回三步操作，避免了數(shù)據(jù)沖突問題。運算單元的處理上采用了不恢復余數(shù)算法的除法器，提高計算速度。在中斷系統(tǒng)的設計上，對22個中斷源的中斷仲裁采取分組并行、三級串行的仲裁電路。 本文還搭建了針對內核的驗證平臺，對51指令集進行了功能驗證，對流水線沖突等問題做了焦點驗證，同時隨機生成中斷源對中斷系統(tǒng)的進行了相應的功能驗證。最后在SMIC0.13μm工藝下對設計進行了邏輯綜合，其頻率可達100MHz，面積為18.5萬μm2。
【關鍵詞】：51內核 流水線 數(shù)據(jù)沖突 功能驗證 單片機
【學位授予單位】：西安電子科技大學
【學位級別】：碩士
【學位授予年份】：2014
【分類號】：TP368.1
【目錄】：

• 摘要5-6
• Abstract6-9
• 第一章 緒論9-13
• 1.1 課題研究背景9
• 1.2 國內外研究現(xiàn)狀與趨勢9-11
• 1.3 論文主要內容和章節(jié)結構11-13
• 1.3.1 論文主要內容11-12
• 1.3.2 論文章節(jié)結構12-13
• 第二章 典型 8051 內核架構分析13-23
• 2.1 8051 單片機的基本結構13-14
• 2.2 8051 內核技術分析14-21
• 2.2.1 8051 內核指標14-15
• 2.2.2 指令集以及時序分析15-20
• 2.2.3 8051 內核存儲系統(tǒng)20-21
• 2.3 本章小結21-23
• 第三章 兼容 MCS-51 內核的設計23-47
• 3.1 內核的架構設計23-29
• 3.1.1 內核總體設計方案23-26
• 3.1.2 內核接口描述26-28
• 3.1.3 內核內部特殊功能寄存器的描述28-29
• 3.2 微處理器 CISC 指令集的流水線架構29-39
• 3.2.1 流水線技術簡介30-32
• 3.2.2 CISC 指令集系統(tǒng)實現(xiàn)流水線的難點32-33
• 3.2.3 本設計中的流水線實現(xiàn)33-39
• 3.3 微處理器的運算單元39-42
• 3.3.1 運算單元設計分析39-41
• 3.3.2 除法器單元的設計41-42
• 3.4 中斷系統(tǒng)的設計42-46
• 3.4.1 中斷源以及服務程序43-44
• 3.4.2 中斷系統(tǒng)架構設計44-46
• 3.5 本章小結46-47
• 第四章 兼容 MCS-51 的內核的驗證與綜合47-69
• 4.1 微處理器的驗證47-50
• 4.1.1 驗證技術概述47-49
• 4.1.2 微處理器的功能驗證技術49-50
• 4.2 內核的驗證與結果分析50-63
• 4.2.1 內核的功能驗證分析50-52
• 4.2.2 微處理器關鍵點的功能驗證52-54
• 4.2.3 微處理器指令集的功能驗證54-61
• 4.2.4 中斷系統(tǒng)的功能驗證61-63
• 4.3 內核的邏輯綜合63-67
• 4.4 內核的形式驗證67
• 4.5 本章小結67-69
• 第五章 結束語69-71
• 5.1 總結69-70
• 5.2 技術展望70-71
• 致謝71-73
• 參考文獻73-75
• 研究成果75-76

【參考文獻】

中國期刊全文數(shù)據(jù)庫 前6條

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本文編號：564982