基于嵌入式處理器的無(wú)線信息公告屏的研發(fā)
【學(xué)位單位】:杭州電子科技大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位年份】:2011
【中圖分類】:TP368.12;TN873.93
【部分圖文】:
圖3.1PXA27O處理器內(nèi)部結(jié)構(gòu)框圖3.1.2嵌入式微處理器核心板電路設(shè)計(jì)結(jié)構(gòu)PXA27O的芯片封裝為PBGA,其底部引腳數(shù)為360個(gè),0.65Inm的焊球間距,密度相當(dāng)高,所以低層數(shù)PCB(PrintedCircultBoard)線路板無(wú)法滿足嵌入式平臺(tái)核心板電路的布線要求,因此,本系統(tǒng)采用的是六層板布線技術(shù)實(shí)現(xiàn)處理器核心板的設(shè)計(jì),將處理器必要的一些外設(shè)引腳輸出至兩根1.27mm間距的2x50芯的標(biāo)準(zhǔn)排針,包括JTAG接口,電源輸入,數(shù)據(jù)總線和地址總線,以及多個(gè)串口,SPI接口,普通GPIO等。這樣將核心板獨(dú)立于其他外設(shè)電路,極大地增強(qiáng)了硬件平臺(tái)的可移植性和通用性。圖3.2為無(wú)線信息公告屏核心板的整體布局。核心板電路布局比較集中,面積較小,這樣既降低了制板成本,也便于整個(gè)系統(tǒng)的集成。將必要的一些核心電路集中到了一塊核心板上,極大地方便了產(chǎn)品的設(shè)計(jì)和開發(fā)調(diào)試,同時(shí),在某些有強(qiáng)電磁千擾的應(yīng)用電路中,可以通過(guò)使核心板遠(yuǎn)離干擾源而增加整個(gè)電路的設(shè)計(jì)可靠性。
一些外設(shè)引腳輸出至兩根1.27mm間距的2x50芯的標(biāo)準(zhǔn)排針,包括JTAG接口,電源輸入,數(shù)據(jù)總線和地址總線,以及多個(gè)串口,SPI接口,普通GPIO等。這樣將核心板獨(dú)立于其他外設(shè)電路,極大地增強(qiáng)了硬件平臺(tái)的可移植性和通用性。圖3.2為無(wú)線信息公告屏核心板的整體布局。核心板電路布局比較集中,面積較小,這樣既降低了制板成本,也便于整個(gè)系統(tǒng)的集成。將必要的一些核心電路集中到了一塊核心板上,極大地方便了產(chǎn)品的設(shè)計(jì)和開發(fā)調(diào)試
杭州電子科技大學(xué)碩士學(xué)位論文地址線BAO和BA一。地址總線MA〔10一22」對(duì)應(yīng)于sD似M的Ao一A12,nSDCASRAS分別接SDRAM的CAS和RAS引腳,進(jìn)行SDRAM尋址時(shí)PXA27O硬件自動(dòng)nsDeAs和nsDRAS的值對(duì)行列進(jìn)行尋址,DQM[o一l」連接SDRAMUDQM和LDQM六六和和和和和A一1幻閱閱閱閱
【參考文獻(xiàn)】
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