【摘要】：評(píng)測訪存延遲對(duì)于優(yōu)化應(yīng)用訪存模式和數(shù)據(jù)放置有重要的指導(dǎo)意義,然而數(shù)據(jù)Cache、多線程、數(shù)據(jù)預(yù)取等技術(shù)卻嚴(yán)重干擾了訪存延遲測量的精度。設(shè)計(jì)并實(shí)現(xiàn)了基于可變步長的訪存延遲測量模型,在一塊空間內(nèi)根據(jù)用戶指定的步長創(chuàng)建訪問序列環(huán),循環(huán)訪問這個(gè)序列得出平均時(shí)間,即為訪存延遲。最后對(duì)Intel的通用處理器和飛騰處理器在不同數(shù)據(jù)大小、步長、線程數(shù)等情況下的訪存延遲進(jìn)行了測量比較,該模型能夠顯示存儲(chǔ)層次并精確顯示測量延遲。
【作者單位】： 國防科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院;
【基金】：國家973計(jì)劃資助項(xiàng)目(2009CB320503)
【分類號(hào)】：TP332

【參考文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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【相似文獻(xiàn)】

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本文編號(hào)：2536419