發(fā)布時(shí)間：2018-10-17 13:50

【摘要】：近些年來(lái),內(nèi)存性能的提升已成為整個(gè)計(jì)算機(jī)系統(tǒng)性能提升的瓶頸,而在內(nèi)存系統(tǒng)結(jié)構(gòu)的研究中,如何快速獲取大量詳細(xì)的系統(tǒng)訪存蹤跡信息成為對(duì)大數(shù)據(jù)應(yīng)用行為分析研究的關(guān)鍵。況且,由于DDR內(nèi)存總線上的數(shù)據(jù)速率的不斷提升,現(xiàn)有的部分訪存蹤跡收集工具已經(jīng)無(wú)法滿足其對(duì)于準(zhǔn)確獲取較高數(shù)據(jù)速率下高訪存帶寬應(yīng)用的訪存蹤跡收集需要。因此,在本文中主要針對(duì)現(xiàn)有的HMTT v3訪存蹤跡收集平臺(tái)的FPGA內(nèi)部邏輯進(jìn)行了重新設(shè)計(jì)和優(yōu)化,以滿足當(dāng)前訪存蹤跡采集的需求。作者完成的主要工作如下：(1)將HMTT v3訪存蹤跡收集平臺(tái)能夠支持的DDR3總線速率從DDR3-800提升至DDR3-1600；(2)使HMTT v3訪存蹤跡收集平臺(tái)能夠同時(shí)處理四路DDR3總線上發(fā)送來(lái)的DDR3命令、地址以及控制信息,并輸出對(duì)應(yīng)的系統(tǒng)訪存蹤跡信息；(3)通過(guò)采用兩種不同的訪存蹤跡包的格式,在對(duì)訪存蹤跡包進(jìn)行壓縮的同時(shí),完整地保留下包括完整訪存時(shí)間間隔的訪存蹤跡信息；(4)針對(duì)訪存蹤跡包在傳輸及存儲(chǔ)上的需求,研究并實(shí)現(xiàn)了在PCIe傳輸通道下將訪存蹤跡信息準(zhǔn)確且不丟失地傳輸?shù)浇邮諜C(jī)端上去的功能；(5)為現(xiàn)有的HMTT v3平臺(tái)實(shí)現(xiàn)了多內(nèi)存環(huán)境下的應(yīng)用擴(kuò)展,并實(shí)現(xiàn)了在同一內(nèi)存通道內(nèi)同時(shí)獲取兩個(gè)內(nèi)存插槽上的系統(tǒng)訪存行為的功能。本文所完成的工作實(shí)現(xiàn)了在HMTT v3訪存蹤跡收集平臺(tái)的環(huán)境下,成功獲取DDR3-1600速率下的系統(tǒng)訪存蹤跡,并將獲取到的系統(tǒng)訪存蹤跡準(zhǔn)確無(wú)誤地傳輸?shù)浇邮諜C(jī)端進(jìn)行存儲(chǔ)的功能。目前,本文完成的工作已經(jīng)用于多個(gè)大數(shù)據(jù)應(yīng)用的訪存蹤跡收集,為大數(shù)據(jù)訪存行為的分析提供了強(qiáng)有力的支持,其分析的結(jié)果已經(jīng)開(kāi)始用于新的內(nèi)存系統(tǒng)結(jié)構(gòu)的設(shè)計(jì)與優(yōu)化。
[Abstract]:In recent years, the improvement of memory performance has become the bottleneck of improving the performance of the whole computer system. How to quickly obtain a large number of detailed systematic information is the key to the analysis of big data's application behavior. Moreover, due to the continuous improvement of the data rate on the DDR memory bus, the existing part of the access and trace collection tools can no longer meet the need for accurate access and trace collection of high access bandwidth applications at higher data rates. Therefore, this paper redesigns and optimizes the FPGA internal logic of the existing HMTT v3 access and trace collection platform to meet the needs of current access and trace collection. The main works of the author are as follows: (1) the rate of DDR3 bus supported by HMTT v3 can be increased from DDR3-800 to DDR3-1600; (2) HMTT v3 can process DDR3 commands sent from four DDR3 bus at the same time. Address and control information, and output the corresponding system access and trace information; (3) by adopting two different formats of track access packet, while compressing the packet, (4) for the transmission and storage requirements of the access packet, This paper studies and realizes the function of transferring the track information to the receiver accurately and without losing in the PCIe transmission channel. (5) it implements the application extension in the multi-memory environment for the existing HMTT v3 platform. The memory access behavior of two memory slots is obtained simultaneously in the same memory channel. In the environment of HMTT v3 access and trace collection platform, this paper has successfully acquired the system access and trace under the DDR3-1600 rate, and transferred the acquired system to the receiver accurately for storage. At present, the work done in this paper has been used to collect the trace of several big data applications, which provides a powerful support for the analysis of big data's memory access behavior. The results of the analysis have been applied to the design and optimization of the new memory system structure.
【學(xué)位授予單位】：中國(guó)科學(xué)院大學(xué)(工程管理與信息技術(shù)學(xué)院)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2016
【分類號(hào)】：TP333.1

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本文編號(hào)：2276867