本文選題：B總線 + 通信終端��； 參考：《計算機(jī)應(yīng)用》2014年03期

【摘要】：為滿足航天飛行器地面仿真設(shè)備使用的需求,設(shè)計了一種基于可編程邏輯門陣列(FPGA)的1553B總線通信終端知識產(chǎn)權(quán)(IP)核。在保證總線系統(tǒng)可靠性的前提下,采用自頂向下的設(shè)計方法與"雙進(jìn)程"編碼方式,利用超高速硬件描述語言(VHDL)生成目標(biāo)代碼,使用ModelSim軟件進(jìn)行仿真,最后在實際設(shè)備中驗證并應(yīng)用。該IP核可配置在總線控制器、遠(yuǎn)程終端或總線監(jiān)控器3種不同的工作模式下運行,易于集成入片上系統(tǒng)(SoC),對進(jìn)一步應(yīng)用1553B總線提供了更多的選擇。
[Abstract]:A 1553B bus communication terminal IP core based on programmable logic gate array (FPGA) is designed to meet the requirements of ground simulation equipment for aerospace vehicles. Under the premise of ensuring the reliability of the bus system, the top-down design method and "double process" coding method are used to generate the target code by using the ultra-high speed hardware description language (VHDL), and the simulation is carried out by using ModelSim software. Finally, it is verified and applied in the actual equipment. The IP core can be configured to operate in three different working modes: bus controller, remote terminal or bus monitor. It is easy to be integrated into the on-chip system and provides more options for further application of 1553B bus.
【作者單位】： 中國科學(xué)技術(shù)大學(xué)軟件學(xué)院;首都師范大學(xué)信息工程學(xué)院;
【分類號】：TP336

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【二級參考文獻(xiàn)】

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2 胡s，

本文編號：1952391