本文選題：內(nèi)存系統(tǒng) + 可靠性　； 參考：《計算機輔助設(shè)計與圖形學(xué)學(xué)報》2014年09期

【摘要】：針對內(nèi)存系統(tǒng)中高強度的容錯編碼容易造成過大開銷的問題,為同時實現(xiàn)容錯強度和容錯開銷的權(quán)衡,提出一種低開銷的支持混合容錯編碼的動態(tài)調(diào)節(jié)設(shè)計.通過分析發(fā)現(xiàn)常見糾錯檢錯編碼數(shù)據(jù)位長與校驗位長存在固定的比例關(guān)系,提出一種地址映射邏輯電路;當(dāng)系統(tǒng)存取內(nèi)存數(shù)據(jù)及容錯強度發(fā)生調(diào)節(jié)時,該方法可保證容錯編碼中校驗信息的存取,實現(xiàn)對內(nèi)存容錯強度調(diào)節(jié)以及數(shù)據(jù)與校驗信息在內(nèi)存中分開存儲的支持.實驗結(jié)果表明,文中設(shè)計簡單,硬件和性能代價小、功耗開銷低.
[Abstract]:Aiming at the problem that high intensity fault-tolerant coding in memory system can easily cause excessive overhead, a low-overhead dynamic adjustment design supporting hybrid fault-tolerant coding is proposed to realize the trade-off between fault-tolerant intensity and fault-tolerant overhead.By analyzing the common error correction code data bit length and checking bit length in a fixed proportion, an address mapping logic circuit is proposed, when the system accesses memory data and the fault-tolerant intensity is adjusted,This method can guarantee the access of the check information in the fault-tolerant coding, and realize the support of adjusting the fault-tolerant strength of the memory and storing the data and the check information separately in the memory.The experimental results show that the design is simple, the cost of hardware and performance is low, and the cost of power consumption is low.
【作者單位】： 計算機體系結(jié)構(gòu)國家重點實驗室;中國科學(xué)院計算技術(shù)研究所;中國科學(xué)院大學(xué);
【基金】：國家自然科學(xué)基金項目(61076018,61274030) 國家“九七三”重點基礎(chǔ)研究計劃基金項目(2011CB302503) 中國科學(xué)院計算技術(shù)研究所-華為聯(lián)合實驗室項目(YBCB2011030)
【分類號】：TP302.8

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本文編號：1772760