本文選題：指令存儲器　切入點：低功耗　出處：《微電子學與計算機》2015年12期 　論文類型：期刊論文

【摘要】：為有效解決目前嵌入式微處理器設(shè)計中指令存儲器功耗大、能效不高的問題,研究了傳統(tǒng)指令存儲器實現(xiàn)方式的特點,分析了指令存儲器功耗和能效隨容量變化的規(guī)律,提出了基于時鐘控制和分塊管理的指令存儲器高效能組織模型,設(shè)計并實現(xiàn)了基于SRAM塊矩陣布局方式的指令存儲器管理方法.結(jié)果表明,本設(shè)計能夠大幅降低指令存儲器功耗,提高指令存儲器能效.和傳統(tǒng)指令存儲器實現(xiàn)方式相比,動態(tài)功耗降低了74.93%,能效提高了3.99倍.
[Abstract]:In order to effectively solve the problem of high power consumption and low energy efficiency of instruction memory in embedded microprocessor design, the characteristics of traditional instruction memory implementation mode are studied, and the rule that the power consumption and energy efficiency of instruction memory vary with capacity is analyzed. This paper presents a high performance organization model of instruction memory based on clock control and block management, and designs and implements an instruction memory management method based on SRAM block matrix layout. The results show that the design can greatly reduce the power consumption of instruction memory. Compared with the traditional instruction memory, the dynamic power consumption is reduced by 74.933 times and the energy efficiency is increased by 3.99 times.
【作者單位】： 解放軍信息工程大學;
【基金】：國家自然科學基金(61404175)
【分類號】：TP333

【參考文獻】

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【二級參考文獻】

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本文編號：1649416