隨著科學(xué)技術(shù)的發(fā)展，導(dǎo)航系統(tǒng)技術(shù)在軍事武器中的應(yīng)用越來(lái)越廣泛，在海軍導(dǎo)彈武器發(fā)射平臺(tái)上也有應(yīng)用。本文直接目的是研究開(kāi)發(fā)一個(gè)艦載導(dǎo)彈垂直發(fā)射系統(tǒng)局部基準(zhǔn)的核心接口處理電路板，系統(tǒng)接口處理電路接口板形式多種多樣且可以與艦載船舶里程表、全球定位衛(wèi)星導(dǎo)航系統(tǒng)Global PositioningSystem（以下簡(jiǎn)稱GPS）、捷聯(lián)慣性導(dǎo)航系統(tǒng)Strapdown Inertial Navigation System（以下簡(jiǎn)稱SINS）、轉(zhuǎn)臺(tái)和管理機(jī)通信，經(jīng)過(guò)數(shù)據(jù)融合過(guò)程中所需的命令解析后，將各種數(shù)據(jù)發(fā)送到各種武器控制平臺(tái)。本文首先分析了其中一種組合導(dǎo)航方式，即SINS和GPS的組合導(dǎo)航。并確定本系統(tǒng)采用松散的位置、速度組合導(dǎo)航算法，設(shè)計(jì)給出了其數(shù)據(jù)處理方法——基于卡爾曼濾波濾波的狀態(tài)方程和測(cè)量方程的數(shù)據(jù)融合算法。其次，針對(duì)組合慣性導(dǎo)航系統(tǒng)板卡與各個(gè)武器控制平臺(tái)的不同接口需求，本文著重闡述了核心電路的工程實(shí)現(xiàn)。本設(shè)計(jì)中將整個(gè)系統(tǒng)的硬件電路采取分模塊的方法，設(shè)計(jì)了以DSP芯片和FPGA芯片為核心控制處理器的電路。圍繞DSP和FPGA的核心電路設(shè)計(jì)了基于高級(jí)數(shù)據(jù)鏈路控制High-Level Data L... 

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【文章頁(yè)數(shù)】：80 頁(yè)

【學(xué)位級(jí)別】：碩士

【文章目錄】：
摘要
Abstract
第1章 緒論
    1.1 課題背景和研究目的與意義
    1.2 嵌入式技術(shù)的應(yīng)用
    1.3 國(guó)外系統(tǒng)發(fā)展情況
    1.4 本文主要研究?jī)?nèi)容
第2章 組合導(dǎo)航模型
    2.1 引言
    2.2 組合導(dǎo)航信息融合技術(shù)
        2.2.1 信息融合技術(shù)的一般原理
        2.2.2 卡爾曼濾波器原理
        2.2.3 組合導(dǎo)航系統(tǒng)的狀態(tài)方程
    2.3 GPS/SINS 組合導(dǎo)航系統(tǒng)
        2.3.1 松散組合
        2.3.2 緊密組合
        2.3.3 深度組合
    2.4 本章小結(jié)
第3章 系統(tǒng)設(shè)計(jì)
    3.1 引言
    3.2 需求分析
    3.3 嵌入式組合導(dǎo)航電路架構(gòu)設(shè)計(jì)
        3.3.1 FPGA 器件選型及設(shè)計(jì)
        3.3.2 DSP 器件選型及設(shè)計(jì)
    3.4 武控臺(tái)的接口電路設(shè)計(jì)
    3.5 協(xié)調(diào)管理機(jī)的接口電路設(shè)計(jì)
    3.6 轉(zhuǎn)臺(tái)控制板的接口電路設(shè)計(jì)
    3.7 慣組 DSP 板的接口電路設(shè)計(jì)
    3.8 載艦的接口電路設(shè)計(jì)
    3.9 GPS 定位導(dǎo)航模塊設(shè)計(jì)
    3.10 MPU6050 模塊電路設(shè)計(jì)
    3.11 本章小結(jié)
第4章 系統(tǒng)硬件電路設(shè)計(jì)
    4.1 前言
    4.2 外擴(kuò) SDRAM 接口電路
    4.3 電源供給電路
        4.3.1 系統(tǒng)功耗計(jì)算
        4.3.2 電源電路設(shè)計(jì)
    4.4 SD 卡電路設(shè)計(jì)
    4.5 RS232 電路設(shè)計(jì)
    4.6 RS422 電路設(shè)計(jì)
    4.7 以太網(wǎng)口控制電路設(shè)計(jì)
    4.8 HDLC 電路設(shè)計(jì)
    4.9 本章小結(jié)
第5章 系統(tǒng)軟件設(shè)計(jì)
    5.1 引言
    5.2 組合慣性導(dǎo)航系統(tǒng)軟件體系架構(gòu)
    5.3 NiosII 嵌入式軟核設(shè)計(jì)
        5.3.1 NiosII 嵌入式處理器
        5.3.2 NiosII 嵌入式處理器特點(diǎn)
        5.3.3 NiosII 嵌入式開(kāi)發(fā)工具
        5.3.4 NiosII 開(kāi)發(fā)流程
    5.4 DSP 設(shè)計(jì)
        5.4.1 TMS320C6713 處理器簡(jiǎn)介
        5.4.2 CCS 集成開(kāi)發(fā)工具
        5.4.3 DSP 設(shè)計(jì)開(kāi)發(fā)流程
    5.5 GPS 定位導(dǎo)航驅(qū)動(dòng)設(shè)計(jì)
    5.6 MPU6050 驅(qū)動(dòng)設(shè)計(jì)
    5.7 SDRAM 接口驅(qū)動(dòng)設(shè)計(jì)
    5.8 SD 卡接口驅(qū)動(dòng)設(shè)計(jì)
    5.9 DSP 數(shù)據(jù)融合算法設(shè)計(jì)
    5.10 UART 串口驅(qū)動(dòng)設(shè)計(jì)
    5.11 以太網(wǎng)接口驅(qū)動(dòng)設(shè)計(jì)
        5.11.1 以太網(wǎng)接口與 FPGA 器件的通訊
        5.11.2 以太網(wǎng)接口與維護(hù)計(jì)算機(jī)通訊
    5.12 增強(qiáng)型 USART IP 設(shè)計(jì)
    5.13 HDLC 接口驅(qū)動(dòng)設(shè)計(jì)
    5.14 本章小結(jié)
第6章 系統(tǒng)軟硬件測(cè)試
    6.1 引言
    6.2 UART 串口調(diào)試
    6.3 SDRAM 控制器調(diào)試
    6.4 DM9000 以太網(wǎng)口控制器調(diào)試
    6.5 SD 卡控制器調(diào)試
    6.6 MPU6050 模塊調(diào)試
    6.7 JS71175 電路調(diào)試
    6.8 系統(tǒng)供電電路調(diào)試
    6.9 跑車試驗(yàn)
    6.10 本章小結(jié)
結(jié)論
參考文獻(xiàn)
致謝
個(gè)人簡(jiǎn)歷


【參考文獻(xiàn)】：
期刊論文
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