非均勻DFT快速實現(xiàn)算法及其應(yīng)用研究
【圖文】:
國防科學(xué)技術(shù)大學(xué)研究生院碩士學(xué)位論文求,當(dāng)要求數(shù)據(jù)速率提高時,則對外部時鐘以及 FPGA 時鐘資源的要求也就嚴(yán)格起來。2.5.2 時序仿真(1)RAM 單元的仿真這里采用的是雙口 RAM,DSP 傳遞過來的數(shù)據(jù)和和中間存儲的jT 值都需要RAM 來進行緩存,圖 2.8 則是該雙口 RAM 的仿真時序圖。寫入的數(shù)據(jù)是 7 到 1,按照邏輯仿真,由圖可看出讀出的數(shù)據(jù)和輸入的一致,驗證了該仿真的正確性。
(1)RAM 單元的仿真這里采用的是雙口 RAM,DSP 傳遞過來的數(shù)據(jù)和和中間存儲的jT 值都需要RAM 來進行緩存,圖 2.8 則是該雙口 RAM 的仿真時序圖。寫入的數(shù)據(jù)是 7 到 1,按照邏輯仿真,由圖可看出讀出的數(shù)據(jù)和輸入的一致,驗證了該仿真的正確性。圖 2.8 RAM 單元仿真時序圖(2)復(fù)數(shù)乘法單元的仿真由于處理信號有可能是復(fù)數(shù)信號,,所以這里選用的是復(fù)數(shù)乘法器單元,這樣避免了對于復(fù)數(shù)的分散處理模式,節(jié)約了處理時間和編程的復(fù)雜度。圖中給出了 6組復(fù)數(shù)的相乘,對比輸入和輸出的結(jié)果可知,該部分仿真是正確的。
【學(xué)位授予單位】:國防科學(xué)技術(shù)大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2016
【分類號】:TJ765.3
【參考文獻】
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本文編號:2700444
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