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基于時間累加器的二階ΔΣ時間數(shù)字轉換器

發(fā)布時間:2019-10-12 08:29
【摘要】:提出以一個可獲得高的分辨率和寬的信號帶寬的二階ΔΣ時間數(shù)字轉換器(TDC),TDC基于門控環(huán)形振蕩器型TDC并結合時間差加法器構成的時間累加器實現(xiàn)了二階量化噪聲整形。采用SMIC 28nm工藝設計,Spectre仿真結果表明,在1 M帶寬內噪聲底約為-82 d Bps~2/Hz,等效到50 Ms/s奈奎斯特率型TDC的分辨率約為2 ps,功耗取決于輸入時間間隔,在測量間隔1ns時功耗約為1.19 mW。受到結構限制,這種類型時間數(shù)字轉換器輸入范圍較小。
【作者單位】: 中國科學院微電子研究所;中國科學院大學;
【基金】:國家自然科學基金(61474134)
【分類號】:TN702

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本文編號:2547970

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