FPGA高級開發(fā)技術(shù)的研究
本文選題:FPGA + 高層次綜合 ; 參考:《北京理工大學》2015年碩士論文
【摘要】:本文的主要研究內(nèi)容是FPGA(Field Programmable Gate Array)的高級開發(fā)技術(shù)具體研究內(nèi)容包括三種主流的高級開發(fā)技術(shù):高層次綜合技術(shù)DSP系統(tǒng)生成技術(shù)和模塊化IP集成和封裝技術(shù)詳細介紹了上述三種高級開發(fā)技術(shù)的應用流程并結(jié)合實際的應用例子與傳統(tǒng)的FPGA開發(fā)方式進行深入對比 FPGA技術(shù)經(jīng)過近年來的發(fā)展已經(jīng)成為數(shù)字處理系統(tǒng)中的主流技術(shù)之一但是傳統(tǒng)RTL級的硬件描述語言具有開發(fā)周期長多人協(xié)作困難等問題,阻礙了FPGA的進一步推廣應用為了解決上述問題,目前不論是FPGA廠商還是第三方工具廠商,都致力于推出各種高級開發(fā)技術(shù)和高級開發(fā)工具本文的主要目的就是分析和評估這些工具內(nèi)在原理應用方式和實用效果,為復雜系統(tǒng)中的FPGA快速開發(fā)解決工具選擇的問題 本文在深入調(diào)研和分析的基礎(chǔ)上,將模塊化IP集成技術(shù)和DSP數(shù)字系統(tǒng)生成技術(shù)等高級開發(fā)技術(shù)應用于一種多通道實時陣列信號處理系統(tǒng)文中詳細介紹了系統(tǒng)的組成相應FPGA固件的開發(fā)方法以及調(diào)試和驗證結(jié)果系統(tǒng)各項性能指標良好工作穩(wěn)定可靠,,體現(xiàn)了所用開發(fā)手段的可行性和有效性
[Abstract]:The main research content of this paper is advanced development technology of FPGA(Field Programmable Gate Array. the specific research contents include three main advanced development technologies: high level synthesis technology DSP system generation technology and modular IP integration and encapsulation technology. This paper introduces the application flow of the three advanced development technologies mentioned above and compares them with the traditional FPGA development method with practical application examples. With the development of FPGA technology in recent years, it has become one of the mainstream technologies in digital processing systems. However, the traditional hardware description language at RTL level has many problems, such as long development cycle and difficulty in multi-person cooperation. In order to solve the above problems, whether FPGA manufacturers or third-party tool manufacturers, The main purpose of this paper is to analyze and evaluate the internal principle, application mode and practical effect of these tools, and to solve the problem of tool selection for FPGA rapid development in complex systems On the basis of in-depth investigation and analysis, Advanced development techniques such as modular IP integration technology and DSP digital system generation technology are applied to a multi-channel real-time array signal processing system. The development method and debugging of the corresponding FPGA firmware are introduced in detail in this paper. And verify the results of the system performance indicators are good, stable and reliable, It reflects the feasibility and effectiveness of the development means used.
【學位授予單位】:北京理工大學
【學位級別】:碩士
【學位授予年份】:2015
【分類號】:TN791
【參考文獻】
相關(guān)期刊論文 前10條
1 陳斌;杜仲;周世君;汪浩洋;;一種基于FPGA的數(shù)字下變頻算法設(shè)計[J];電視技術(shù);2011年13期
2 周俊峰,陳濤;基于FPGA的直接數(shù)字頻率合成器的設(shè)計和實現(xiàn)[J];電子技術(shù)應用;2002年12期
3 王茹琪,張愛國,張興敢,肖文書;雷達接收機多通道高速數(shù)據(jù)采集系統(tǒng)[J];電子技術(shù)應用;2005年07期
4 趙遠鴻;宋學瑞;;基于FPGA的數(shù)字下變頻設(shè)計與實現(xiàn)[J];電子技術(shù)應用;2009年02期
5 吳瓊之;蔡春霞;丁一辰;廖春蘭;;5Gsps高速數(shù)據(jù)采集系統(tǒng)的設(shè)計與實現(xiàn)[J];電子設(shè)計工程;2012年01期
6 張德民;李明;李楊;邱智慧;;基于SRIO的FPGA間數(shù)據(jù)交互系統(tǒng)設(shè)計與應用[J];重慶郵電大學學報(自然科學版);2013年06期
7 范秋香;吳瓊之;孫寧霄;金兆健;;AXI標準協(xié)議在微型機載采集設(shè)備中的應用[J];電子設(shè)計工程;2014年03期
8 James Hrica;;利用賽靈思Vivado HLS實現(xiàn)浮點設(shè)計[J];今日電子;2013年01期
9 張薇;呂宏程;邱傳飛;程慧華;周全志;;基于FPGA的DBF設(shè)計與實現(xiàn)[J];火力與指揮控制;2011年06期
10 周婉婷;;高層次綜合的算子調(diào)度與寄存器分配[J];中國集成電路;2007年11期
本文編號:1858560
本文鏈接:http://sikaile.net/kejilunwen/dianzigongchenglunwen/1858560.html