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CCSDS圖像壓縮算法中位平面編碼的VLSI設計

發(fā)布時間:2018-02-07 17:00

  本文關鍵詞: 圖像壓縮 CCSDS FPGA 位平面編碼 并行掃描 出處:《中國科學院大學(中國科學院國家空間科學中心)》2017年碩士論文 論文類型:學位論文


【摘要】:近年來隨著傳感器技術的快速發(fā)展,人們獲取的星載遙感圖像的數(shù)據量正以幾何級數(shù)增長,但由于星載系統(tǒng)資源和數(shù)據下行傳輸帶寬有限,所以圖像壓縮成了必不可缺的環(huán)節(jié)。2005年空間數(shù)據系統(tǒng)資源委員會(CCSDS)發(fā)布了新一代星載圖像壓縮推薦標準CCSDS 122.0-B-1,該標準采用了小波變換技術和位平面編碼方案,支持圖像壓縮從無損到有損連續(xù)可調,并且在兼顧壓縮效率的前提下具有較低的設計復雜度,適用于星載平臺,具有良好的應用前景。論文在深入研究CCSDS標準圖像壓縮算法的基礎上,采用Verilog HDL語言設計了圖像編碼系統(tǒng)。在算法的VLSI實現(xiàn)中位平面編碼模塊是資源消耗的關鍵所在,本文實現(xiàn)了一種新的位平面掃描方案,將原串行掃描方式改進成為并行掃描,掃描時間消耗大大降低,提高了壓縮編碼效率。論文設計了CCSDS算法的VLSI實現(xiàn)架構并做了仿真驗證,主要工作如下:(1)深入研究了CCSDS 122.0-B-1標準,分析了圖像壓縮算法的流程,對其中小波DC系數(shù)編碼、小波AC系數(shù)編碼部分進行了詳細論述。(2)在CCSDS原算法的基礎上進行了優(yōu)化設計,使用并行掃描結構實現(xiàn)位平面掃描編碼。(3)使用Verilog HDL語言設計了圖像壓縮系統(tǒng)的接口模塊和編碼模塊,包括圖像預處理模塊、DC系數(shù)編碼模塊、AC系數(shù)位深編碼、AC系數(shù)編碼等模塊的VLSI設計。(4)使用Modelsim對圖像編碼系統(tǒng)進行功能仿真,驗證系統(tǒng)設計的合理性。
[Abstract]:In recent years, with the rapid development of sensor technology, the data volume of space-borne remote sensing images is increasing in geometric series, but the bandwidth of space-borne system resources and data downlink transmission is limited. In 2005, the Committee of Spatial data system Resources (CCSD) issued a new recommendation standard CCSDS 122.0-B-1, which adopts wavelet transform technology and bit-plane coding scheme. It supports image compression from lossless to lossy continuous tunable, and has low design complexity on the premise of taking into account compression efficiency, so it is suitable for spaceborne platform. It has a good application prospect. Based on the in-depth study of the CCSDS standard image compression algorithm, this paper designs an image coding system using Verilog HDL language. The implementation of the median plane coding module in the VLSI of the algorithm is the key to the resource consumption. In this paper, a new bit-plane scanning scheme is implemented, in which the original serial scanning method is improved to parallel scanning mode, the scanning time consumption is greatly reduced, and the compression coding efficiency is improved. The VLSI implementation architecture of CCSDS algorithm is designed and simulated. The main work is as follows: (1) the CCSDS 122.0-B-1 standard is deeply studied, the flow of image compression algorithm is analyzed, and the wavelet DC coefficient coding and wavelet AC coefficient coding part are discussed in detail.) based on the original CCSDS algorithm, the optimization design is carried out. The interface module and coding module of image compression system are designed by using Verilog HDL language. The VLSI design of the AC coefficient bit depth coding and AC coefficient coding module including the image preprocessing module / DC coefficient coding module. (4) the functional simulation of the image coding system using Modelsim is carried out to verify the reasonableness of the system design.
【學位授予單位】:中國科學院大學(中國科學院國家空間科學中心)
【學位級別】:碩士
【學位授予年份】:2017
【分類號】:TP751

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本文編號:1494862

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