本文關(guān)鍵詞：ASIP可執(zhí)行規(guī)約的集成環(huán)境設(shè)計(jì)研究，由筆耕文化傳播整理發(fā)布。

【摘要】：嵌入式處理器發(fā)展到今天,衍生出了很多研究方向,專用指令集處理器ASIP(Application Specific Instruction Set Processor)是近年來研究的新領(lǐng)域。ASIP是為了彌補(bǔ)通用處理器的不足而設(shè)計(jì)的,可以根據(jù)實(shí)際需求對(duì)有限資源進(jìn)行自定義裁剪來獲取最優(yōu)化的產(chǎn)品,引入了很多新技術(shù)和設(shè)計(jì)理念。在研究過程中也提出了多種ASIP的設(shè)計(jì)方法,從傳統(tǒng)的設(shè)計(jì)方法到行為級(jí)設(shè)計(jì)方法,再到系統(tǒng)級(jí)設(shè)計(jì)方法,直到現(xiàn)在的基于平臺(tái)設(shè)計(jì)方法。每一種設(shè)計(jì)方法都具有各自的優(yōu)點(diǎn)和不足。本文在總結(jié)前人研究經(jīng)驗(yàn)的基礎(chǔ)上,結(jié)合當(dāng)前計(jì)算機(jī)發(fā)展中的新技術(shù),提出了基于互聯(lián)網(wǎng)平臺(tái)的可執(zhí)行ASIP集成設(shè)計(jì)環(huán)境。本文提出的這種設(shè)計(jì)理念是把系統(tǒng)級(jí)綜合與基于平臺(tái)的設(shè)計(jì)相結(jié)合的新方法。其思想是嘗試在ASIP設(shè)計(jì)中融合先進(jìn)的互聯(lián)網(wǎng)平臺(tái)與云計(jì)算技術(shù),從而來構(gòu)建ASIP在線設(shè)計(jì)平臺(tái),對(duì)ASIP的特點(diǎn)和體系結(jié)構(gòu)進(jìn)行建模,可執(zhí)行實(shí)現(xiàn)和仿真。設(shè)計(jì)時(shí)將ASIP的系統(tǒng)級(jí)設(shè)計(jì)任務(wù)劃分為行為、結(jié)構(gòu)、綜合3個(gè)層次,以參數(shù)化的體系結(jié)構(gòu)模型作為核心,把統(tǒng)一建模語言UML(Unified Modeling Language)描述的ASIP系統(tǒng)模型采用模型轉(zhuǎn)換的方法序列化成可擴(kuò)展標(biāo)記語言XML(Extensible Markup Language)。由于XML語言能夠更為細(xì)化的描述ASIP的體系結(jié)構(gòu)以及與互聯(lián)網(wǎng)技術(shù)無縫銜接,因此選用XML存儲(chǔ)ASIP結(jié)構(gòu)的分層模型。下一步使用PHP技術(shù)為基礎(chǔ)對(duì)XML模型進(jìn)行解析翻譯,通過編譯技術(shù)和模板映射成可執(zhí)行的VHDL程序,同時(shí)可以把生成的代碼作為模板存儲(chǔ)于數(shù)據(jù)庫中,方便在以后的設(shè)計(jì)中模塊重用。設(shè)計(jì)環(huán)境的軟件實(shí)現(xiàn)以THinkPHP框架構(gòu)建服務(wù)器邏輯,使用jQuery-EasyUI來實(shí)現(xiàn)用戶界面,在生成VHDL代碼后還能夠?qū)SIP流水線進(jìn)行仿真,測(cè)試,形成實(shí)用的ASIP集成設(shè)計(jì)環(huán)境。
【關(guān)鍵詞】：ASIP XML 互聯(lián)網(wǎng)平臺(tái) 流水線 集成設(shè)計(jì)環(huán)境
【學(xué)位授予單位】：武漢紡織大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2016
【分類號(hào)】：TP332
【目錄】：

• 摘要4-5
• Abstract5-8
• 1 緒論8-14
• 1.1 選題的背景及研究的意義8-10
• 1.1.1 嵌入式系統(tǒng)8-9
• 1.1.2 ASIP的研究意義9-10
• 1.2 ASIP在國(guó)內(nèi)外的研究現(xiàn)狀與發(fā)展趨勢(shì)10-12
• 1.2.1 ASIP設(shè)計(jì)空間探索11
• 1.2.2 TTA架構(gòu)的ASIP設(shè)計(jì)11
• 1.2.3 基于Petri網(wǎng)的ASIP建模11-12
• 1.2.4 ADL驅(qū)動(dòng)的ASIP框架12
• 1.2.5 團(tuán)隊(duì)已經(jīng)進(jìn)行過的研究12
• 1.3 研究的目標(biāo)12-13
• 1.4 論文的結(jié)構(gòu)13-14
• 2 ASIP可執(zhí)行設(shè)計(jì)規(guī)約14-20
• 2.1 嵌入式系統(tǒng)設(shè)計(jì)方法學(xué)14-15
• 2.1.1 基于IP復(fù)用的設(shè)計(jì)方法學(xué)14-15
• 2.1.2 軟硬件協(xié)同的設(shè)計(jì)方法學(xué)15
• 2.1.3 基于平臺(tái)的設(shè)計(jì)方法學(xué)15
• 2.2 ASIP設(shè)計(jì)方法學(xué)15-18
• 2.2.1 傳統(tǒng)的ASIP設(shè)計(jì)方法15-16
• 2.2.2 ASIP行為級(jí)設(shè)計(jì)方法16-17
• 2.2.3 ASIP系統(tǒng)級(jí)設(shè)計(jì)方法17
• 2.2.4 基于互聯(lián)網(wǎng)的ASIP系統(tǒng)級(jí)設(shè)計(jì)方法17-18
• 2.3 可執(zhí)行設(shè)計(jì)規(guī)約18-19
• 2.4 本章小結(jié)19-20
• 3 可執(zhí)行ASIP的研究路線與技術(shù)20-26
• 3.1 ASIP集成設(shè)計(jì)環(huán)境的技術(shù)路線20-21
• 3.2 設(shè)計(jì)實(shí)現(xiàn)的主要技術(shù)21-25
• 3.2.1 ADL體系結(jié)構(gòu)描述語言21-22
• 3.2.2 HDL硬件描述語言22-23
• 3.2.3 PHP和ThinkPHP框架23
• 3.2.4 jQuery-EasyUI23-24
• 3.2.5 MVC設(shè)計(jì)模式24-25
• 3.3 本章小結(jié)25-26
• 4 XML模型轉(zhuǎn)化為可執(zhí)行HDL26-45
• 4.1 XML模型的建立26-29
• 4.1.1 ASIP體系結(jié)構(gòu)26-27
• 4.1.2 XML描述的ASIP體系結(jié)構(gòu)27-29
• 4.2 可執(zhí)行VHDL的實(shí)現(xiàn)29-44
• 4.2.1 編譯器的設(shè)計(jì)29-33
• 4.2.2 XML模型的解析33-38
• 4.2.3 生成可執(zhí)行VHDL38-44
• 4.3 本章小結(jié)44-45
• 5 ASIP集成設(shè)計(jì)環(huán)境實(shí)現(xiàn)與仿真45-57
• 5.1 系統(tǒng)功能結(jié)構(gòu)設(shè)計(jì)45-46
• 5.2 用戶界面實(shí)現(xiàn)46-50
• 5.3 系統(tǒng)數(shù)據(jù)庫的實(shí)現(xiàn)50-52
• 5.4 ASIP流水線仿真測(cè)試的實(shí)現(xiàn)52-55
• 5.5 本章小結(jié)55-57
• 6 結(jié)論57-59
• 6.1 結(jié)束語57
• 6.2 展望57-59
• 參考文獻(xiàn)59-63
• 附錄63-64
• 附錄Ⅰ63-64
• 致謝64

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