隨著社會(huì)科技不斷發(fā)展,無線通信領(lǐng)域的頻譜資源日益緊張,在這種背景下,擁有自適應(yīng)特性的認(rèn)知無線電技術(shù)應(yīng)運(yùn)而生。認(rèn)知無線電能夠通過充分利用處于空閑狀態(tài)的授權(quán)頻段來提升頻譜效率。本文面向基于認(rèn)知無線電的非連續(xù)正交頻分復(fù)用（Non-Contigous Orthogonal Frequency Division Multiplexing,NC-OFDM）通信鏈路,針對(duì)部分帶寬不可用或者受到干擾的通信信道,研究分析了NC-OFD M系統(tǒng)信號(hào)的同步技術(shù)、峰均比抑制技術(shù),完成了兩個(gè)算法方案與射頻模塊的硬件接口的設(shè)計(jì)和實(shí)現(xiàn)。論文具體內(nèi)容如下:首先簡(jiǎn)要介紹了NC-OFDM技術(shù)的基本原理,分析了NC-OFDM系統(tǒng)的關(guān)鍵技術(shù),給出NC-OFDM系統(tǒng)的鏈路模型并對(duì)各個(gè)子模塊的功能進(jìn)行了描述。其次分析了時(shí)間同步誤差和頻率同步誤差對(duì)系統(tǒng)性能的影響。將非數(shù)據(jù)輔助類同步算法中典型的基于循環(huán)前綴的最大似然算法應(yīng)用于NC-OFDM系統(tǒng)并進(jìn)行Matlab仿真分析。然后針對(duì)NC-OFDM系統(tǒng)中的抗干擾同步需求,提出一種基于ZC訓(xùn)練序列的抗干擾同步方案,通過多個(gè)相關(guān)值聯(lián)合判決的方式進(jìn)行時(shí)頻同步并對(duì)其應(yīng)用于不可用子載波存在較強(qiáng)干擾... 

【文章來源】：電子科技大學(xué)四川省 211工程院校 985工程院校 教育部直屬院校

【文章頁(yè)數(shù)】：107 頁(yè)

【學(xué)位級(jí)別】：碩士

【部分圖文】：

成型濾波器的FDATOOL設(shè)計(jì)

第五章同步算法和峰均比抑制算法的FPGA實(shí)現(xiàn)69的DSP48資源，整體消耗滿足設(shè)計(jì)要求。表5-6峰均比抑制實(shí)現(xiàn)資源消耗資源可用數(shù)量使用數(shù)量占用率查找表20380029471.44%觸發(fā)器40760084372.07%塊存儲(chǔ)器DSP4844584013832.92%9.88%5.4硬件接口開發(fā)設(shè)計(jì)5.4.1DAC接口介紹與開發(fā)基帶子系統(tǒng)通過DAC接口將數(shù)字中頻信號(hào)傳輸給射頻子系統(tǒng)中的射頻發(fā)送模塊。DAC芯片型號(hào)選擇TI公司的DAC5672A。DAC5672A器件為一款電壓基準(zhǔn)的單片雙通道14bit高速ADC芯片，它可在最高275MSPS更新速率下工作。DAC5672A有兩個(gè)14bit并行輸入端口，有獨(dú)立的數(shù)據(jù)鎖存器和時(shí)鐘，在交錯(cuò)模式下工作時(shí)，DAC5672A支持端口上DAC的多路復(fù)用數(shù)據(jù)[41]。DAC5672A的功能模塊圖如圖5-37所示。圖5-37DAC5672A功能模塊圖

第五章同步算法和峰均比抑制算法的FPGA實(shí)現(xiàn)71PhaseWidth設(shè)置為16位，步進(jìn)PhaseAngleIncrement設(shè)置為11011110001，輸出頻率為5M的正弦信號(hào)，將輸出接在示波器上觀察，示波器上顯示為5M的正弦波信號(hào)，如圖5-38所示。將DDS步進(jìn)PhaseAngleIncrement設(shè)置為101000010001110，輸出頻率為58M的正弦信號(hào)，將輸出接在頻譜儀上，在頻譜儀上顯示為58M的單音信號(hào)，結(jié)果如圖5-39所示。圖5-38示波器顯示圖5-39頻譜儀顯示

【參考文獻(xiàn)】：
期刊論文
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博士論文
[1]NC-OFDM動(dòng)態(tài)頻譜共享系統(tǒng)的關(guān)鍵技術(shù)[D]. 侯煒.清華大學(xué) 2010

碩士論文
[1]基于變換域通信系統(tǒng)的改進(jìn)與實(shí)現(xiàn)[D]. 柯英豪.電子科技大學(xué) 2016



本文編號(hào)：2908179