本文關鍵詞：應用于高速串行通信的部分響應均衡技術的設計與實現

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【摘要】：隨著信息化時代的快速發(fā)展,人們對通信系統(tǒng)的帶寬要求日益增加,作為減少碼間干擾的主要措施,均衡技術得到了廣泛的應用。其中,部分響應均衡技術因其可以有效實現更高速率串行通信,而越來越成為國內外的研究的熱點。本文基于CMOS 0.18μm工藝設計實現了應用于1OGb/s高速串行通信中的部分響應均衡器。該均衡器采用兩路過采樣結構并結合信道固有的頻率衰減特性,在接收端得到了雙二進制信號,從而減小了高速串行通信中的帶寬需求。為了進一步增強部分響應均衡器的性能,采用了高頻峰化技術以及負載電阻和源極電容校準技術,以應對由于工藝角變化帶來的延時偏差的影響。包括焊盤在內的芯片面積為0.835×0.715mm2,在1.8V電源電壓下的功耗為224mW。后仿結果表明,本文設計的均衡器能夠有效工作在1OGb/s速率下,并且獲得超過70%的眼圖張開度。本文設計的均衡器已經流片并進行了測試。為了實現整個通信鏈路的設計,本文還研究了雙二進制均衡的預編碼以及解碼器結構,并完成了高速比較器的電路設計。在當前通信系統(tǒng)帶寬不斷增加的趨勢下,本文研究的部分響應均衡器可以有效減輕信道帶寬需求,從而大幅提高信號傳輸速率,具有實際應用價值。
【學位授予單位】：東南大學
【學位級別】：碩士
【學位授予年份】：2017
【分類號】：TN914

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本文編號：1300452