本文關(guān)鍵詞：梯度學(xué)習(xí)的參數(shù)控制幫助線程預(yù)取模型

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【摘要】：對于非規(guī)則訪存的應(yīng)用程序,當(dāng)某個應(yīng)用程序的訪存開銷大于計算開銷時,傳統(tǒng)幫助線程的訪存開銷會高于主線程的計算開銷,從而導(dǎo)致幫助線程落后于主線程。于是提出一種改進(jìn)的基于參數(shù)控制的幫助線程預(yù)取模型,該模型采用梯度下降算法對控制參數(shù)求解最優(yōu)值,從而有效地控制幫助線程與主線程的訪存任務(wù)量,使幫助線程領(lǐng)先于主線程。實(shí)驗(yàn)結(jié)果表明,基于參數(shù)選擇的線程預(yù)取模型能獲得1.1~1.5倍的系統(tǒng)性能加速比。
【作者單位】： 上海理工大學(xué)光電信息與計算機(jī)工程學(xué)院;上海理工大學(xué)上海市現(xiàn)代光學(xué)系統(tǒng)重點(diǎn)實(shí)驗(yàn)室;
【關(guān)鍵詞】： 數(shù)據(jù)預(yù)取 幫助線程 多核系統(tǒng) 訪存延遲 梯度下降
【基金】：上海市自然科學(xué)基金資助項(xiàng)目(15ZR1428600) 計算機(jī)體系結(jié)構(gòu)國家重點(diǎn)實(shí)驗(yàn)室開放資助項(xiàng)目(CARCH201206) 上海市浦江人才計劃資助項(xiàng)目(16PJ1407600)
【分類號】：TP311.1;TP18
【正文快照】： 在微處理器的發(fā)展進(jìn)入多核時代[1-2]之后,處理器和存儲器之間的速度差距進(jìn)一步拉大,存儲墻[3]問題仍然是制約微處理器性能提升的一個重要瓶頸。數(shù)據(jù)預(yù)取技術(shù)[4]是緩解存儲墻問題的重要手段之一,數(shù)據(jù)預(yù)取利用程序訪存和計算的重疊,在處理器訪問數(shù)據(jù)之前提前發(fā)出訪存請求,隱藏因

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本文編號：1079322