本文關(guān)鍵詞：小型化交會(huì)對(duì)接雷達(dá)跟蹤算法研究和實(shí)現(xiàn)，，由筆耕文化傳播整理發(fā)布。

【摘要】：小型化交會(huì)對(duì)接雷達(dá)跟蹤算法的關(guān)鍵是直接序列擴(kuò)頻信號(hào)跟蹤,而其核心是載波跟蹤和偽碼跟蹤。本文主要對(duì)直接序列擴(kuò)頻信號(hào)的跟蹤算法進(jìn)行研究,并進(jìn)一步研究為了實(shí)現(xiàn)交會(huì)對(duì)接雷達(dá)跟蹤小型化的跟蹤環(huán)路結(jié)構(gòu)與優(yōu)化設(shè)計(jì)方案。論文先說(shuō)明交會(huì)對(duì)接雷達(dá)跟蹤原理,再介紹了常用的跟蹤技術(shù):載波跟蹤和偽碼跟蹤,最后提出了小型化交會(huì)對(duì)接雷達(dá)跟蹤算法的研究與實(shí)現(xiàn)方案。載波環(huán)主要由鎖相環(huán)與鎖頻環(huán)組成。首先對(duì)常見(jiàn)鑒別算法進(jìn)行了分析與比較,再根據(jù)環(huán)路濾波器的模型給出系統(tǒng)函數(shù),最后探討環(huán)路參數(shù)對(duì)環(huán)路性能的影響。碼環(huán)的介紹側(cè)重于工作原理、鑒別算法、濾波器設(shè)計(jì)以及載波輔助四方面的說(shuō)明,并給出鎖相環(huán)、鎖頻環(huán)以及碼環(huán)的測(cè)量誤差的分析。小型化交會(huì)對(duì)接雷達(dá)跟蹤算法研究與實(shí)現(xiàn)主要從碼環(huán)設(shè)計(jì)、載波環(huán)設(shè)計(jì)以及電路結(jié)構(gòu)優(yōu)化設(shè)計(jì)三方面進(jìn)行討論分析。碼環(huán)設(shè)計(jì)主要針對(duì)鑒別器選擇、碼相關(guān)間距以及環(huán)路帶寬參數(shù)設(shè)計(jì)等方面進(jìn)行了研究,通過(guò)仿真分析不同鑒別器類(lèi)型、相關(guān)間距以及環(huán)路帶寬對(duì)碼環(huán)跟蹤性能的影響。載波環(huán)主要是通過(guò)對(duì)鎖頻環(huán)輔助鎖相環(huán)的結(jié)構(gòu)進(jìn)行研究,其中采用二階鎖頻環(huán)與三階鎖相環(huán)聯(lián)合的載波跟蹤環(huán)路結(jié)構(gòu),二階鎖頻環(huán)具備較好的動(dòng)態(tài)跟蹤能力,而三階鎖相環(huán)具備較好的熱噪聲跟蹤精度。通過(guò)仿真比較了鎖頻環(huán)串聯(lián)鎖相環(huán)與鎖頻環(huán)并聯(lián)鎖相環(huán)兩種環(huán)路結(jié)構(gòu)的跟蹤性能。此外,通過(guò)時(shí)分復(fù)用的電路設(shè)計(jì)方法減少了FPGA資源的使用。最后,論文給出了碼環(huán)與載波環(huán)的一種電路實(shí)現(xiàn)結(jié)構(gòu)與設(shè)計(jì)方案,并完成了FPGA實(shí)現(xiàn)以及硬件測(cè)試,最終驗(yàn)證了該小型化跟蹤環(huán)路設(shè)計(jì)方案的正確性。最后,對(duì)本論文的研究工作進(jìn)行了總結(jié),并對(duì)后續(xù)研究進(jìn)行展望。
【關(guān)鍵詞】：小型化 交會(huì)對(duì)接 跟蹤環(huán)路 FPGA
【學(xué)位授予單位】：北京理工大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2016
【分類(lèi)號(hào)】：TN953
【目錄】：

• 摘要5-6
• ABSTRACT6-13
• 第1章 緒論13-18
• 1.1 研究背景13-14
• 1.2 國(guó)內(nèi)外研究發(fā)展動(dòng)態(tài)14-16
• 1.3 課題研究目的及意義16-17
• 1.4 本論文主要工作及內(nèi)容安排17-18
• 第2章 交會(huì)對(duì)接雷達(dá)信號(hào)跟蹤基本原理18-21
• 2.1 交會(huì)對(duì)接測(cè)量雷達(dá)系統(tǒng)18-19
• 2.2 雷達(dá)測(cè)量基本原理19
• 2.3 直接序列擴(kuò)頻信號(hào)跟蹤概述19-20
• 2.4 本章小結(jié)20-21
• 第3章 直接序列擴(kuò)頻信號(hào)跟蹤研究21-46
• 3.1 載波跟蹤環(huán)路研究21-40
• 3.1.1 鎖相環(huán)跟蹤環(huán)路21-36
• 3.1.2 鎖頻環(huán)跟蹤環(huán)路36-40
• 3.2 碼跟蹤環(huán)路40-45
• 3.2.1 基本工作原理40-41
• 3.2.2 鑒別算法41-42
• 3.2.3 濾波器設(shè)計(jì)42-43
• 3.2.4 載波輔助43-44
• 3.2.5 測(cè)量誤差分析44-45
• 3.3 本章小結(jié)45-46
• 第4章 小型化交會(huì)對(duì)接雷達(dá)跟蹤環(huán)路設(shè)計(jì)46-85
• 4.1 碼環(huán)的設(shè)計(jì)優(yōu)化與實(shí)現(xiàn)47-54
• 4.1.1 碼環(huán)路鑒別器選擇47-48
• 4.1.2 碼環(huán)相關(guān)間距的選取48-49
• 4.1.3 碼環(huán)最優(yōu)環(huán)路帶寬設(shè)計(jì)49-52
• 4.1.4 碼環(huán)實(shí)現(xiàn)技術(shù)52-54
• 4.2 載波環(huán)路的優(yōu)化設(shè)計(jì)54-74
• 4.2.1 鎖頻環(huán)串聯(lián)鎖相環(huán)電路設(shè)計(jì)55-63
• 4.2.2 鎖頻環(huán)并聯(lián)鎖相環(huán)電路設(shè)計(jì)63-66
• 4.2.3 仿真驗(yàn)證與分析66-72
• 4.2.4 載波環(huán)優(yōu)化實(shí)現(xiàn)72-74
• 4.3 FPGA實(shí)現(xiàn)字長(zhǎng)截位優(yōu)化設(shè)計(jì)74-76
• 4.4 FPGA電路復(fù)用優(yōu)化設(shè)計(jì)76-77
• 4.4.1 鎖相環(huán)設(shè)計(jì)電路復(fù)用77
• 4.4.2 鎖頻環(huán)設(shè)計(jì)電路復(fù)用77
• 4.4.3 碼環(huán)設(shè)計(jì)電路復(fù)用77
• 4.4.4 電路復(fù)用綜合優(yōu)化77
• 4.5 跟蹤環(huán)路的FPGA實(shí)現(xiàn)77-84
• 4.5.1 跟蹤環(huán)路功能簡(jiǎn)介77-78
• 4.5.2 跟蹤環(huán)路軟件實(shí)現(xiàn)和資源統(tǒng)計(jì)78-81
• 4.5.3 跟蹤環(huán)路功能和性能實(shí)現(xiàn)81-84
• 4.6 本章小結(jié)84-85
• 結(jié)論85-86
• 參考文獻(xiàn)86-89
• 攻讀碩士學(xué)位期間發(fā)表論文89
• 攻讀碩士學(xué)位期間主要科研成果89-90
• 致謝90

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