本文關(guān)鍵詞：寬帶信道化接收機(jī)的研究與實(shí)現(xiàn)，，由筆耕文化傳播整理發(fā)布。

【摘要】：信道化接收機(jī)被廣泛應(yīng)用于電子戰(zhàn)中。本文在充分研究當(dāng)前戰(zhàn)場的電磁環(huán)境的特點(diǎn)的基礎(chǔ)上,研究了基于并行DDC的信道化結(jié)構(gòu)、基于多相濾波的信道化結(jié)構(gòu)、基于加權(quán)疊加的信道化結(jié)構(gòu)、基于DFT調(diào)制濾波器組的動(dòng)態(tài)信道化結(jié)構(gòu),并提出了基于多相濾波的直接中頻信道化結(jié)構(gòu)和基于加權(quán)疊加的直接中頻信道化結(jié)構(gòu)。本文提出的直接中頻信道化結(jié)構(gòu)克服了傳統(tǒng)的信道化結(jié)構(gòu)用于超大帶寬接收機(jī)時(shí)系統(tǒng)復(fù)雜、成本高昂、資源利用率低的缺陷,并且具有一定的動(dòng)態(tài)特性。本文還研究了信道化接收機(jī)中的信號(hào)檢測器,包括恒定噪聲功率下的固定門限檢測器和時(shí)變噪聲功率下的CFAR檢測器本文還研究了信道化接收機(jī)中的參數(shù)編碼器,包括脈沖幅度、脈沖寬度、射頻頻率和到達(dá)時(shí)間4種參數(shù),并詳細(xì)分析了CORDIC算法在參數(shù)編碼器中的應(yīng)用原理及誤差。本文根據(jù)理論研究的成果,設(shè)計(jì)并實(shí)現(xiàn)了一套瞬時(shí)帶寬為1.5GHz、信道數(shù)為30、信道帶寬為50MHz、信道中心頻率可變的數(shù)字信道化接收機(jī)。該設(shè)計(jì)利用單片ADC進(jìn)行中頻采樣,利用單片Xilinx-Virtex6-FPGA實(shí)現(xiàn)基于加權(quán)疊加的直接中頻信道化算法和參數(shù)編碼器,并通過總數(shù)據(jù)率達(dá)30Gbps的15個(gè)RocketIO收發(fā)器輸出脈沖描述字。本文利用MATLAB仿真工具對設(shè)計(jì)進(jìn)行仿真分析,并在硬件平臺(tái)上實(shí)現(xiàn)了該設(shè)計(jì)。
【關(guān)鍵詞】：電子戰(zhàn)接收機(jī) 信道化接收機(jī) 多相濾波 數(shù)字下變頻 信號(hào)檢測 參數(shù)編碼器 CORDIC算法
【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類號(hào)】：TN851
【目錄】：

• 摘要5-6
• ABSTRACT6-9
• 注釋表9-10
• 第一章 緒論10-16
• 1.1 研究背景和意義10-12
• 1.2 國內(nèi)外研究現(xiàn)狀12-15
• 1.3 本文的主要工作15-16
• 第二章 寬帶信道化接收機(jī)的關(guān)鍵技術(shù)16-40
• 2.1 信道化技術(shù)概述16-17
• 2.2 基于并行DDC的信道化技術(shù)17-19
• 2.3 基于多相濾波的信道化技術(shù)19-23
• 2.3.1 偶型劃分的信道化結(jié)構(gòu)20-21
• 2.3.2 奇型劃分的信道化結(jié)構(gòu)21-23
• 2.4 基于加權(quán)疊加的信道化技術(shù)23-24
• 2.5 直接中頻信道化技術(shù)24-30
• 2.5.1 基于多相濾波的直接中頻信道化結(jié)構(gòu)26-28
• 2.5.2 基于加權(quán)疊加的直接中頻信道化結(jié)構(gòu)28-30
• 2.6 基于DFT調(diào)制濾波器組的動(dòng)態(tài)信道化技術(shù)30-32
• 2.7 信道化接收機(jī)中的參數(shù)編碼器32-39
• 2.7.1 信號(hào)的檢測32-35
• 2.7.2 到達(dá)時(shí)間和脈沖寬度的測量35
• 2.7.3 脈沖幅度的測量35-38
• 2.7.4 脈沖頻率的測量38-39
• 2.8 本章小結(jié)39-40
• 第三章 寬帶信道化接收機(jī)的設(shè)計(jì)40-65
• 3.1 系統(tǒng)指標(biāo)40
• 3.2 系統(tǒng)設(shè)計(jì)40-42
• 3.3 硬件設(shè)計(jì)42-45
• 3.3.1 FMC126子卡簡介42-44
• 3.3.2 VPF6363信號(hào)處理卡簡介44
• 3.3.3 硬件的總體框架44-45
• 3.4 軟件設(shè)計(jì)45-57
• 3.4.1 ADC驅(qū)動(dòng)程序設(shè)計(jì)45-46
• 3.4.2 信道化模塊設(shè)計(jì)46-52
• 3.4.3 參數(shù)編碼器設(shè)計(jì)52-54
• 3.4.4 接.模塊設(shè)計(jì)54-57
• 3.5 仿真分析57-64
• 3.5.1 信道化模塊的仿真57-62
• 3.5.2 參數(shù)編碼器模塊的仿真62-64
• 3.6 本章小結(jié)64-65
• 第四章 寬帶信道化接收機(jī)的實(shí)現(xiàn)65-72
• 4.1 實(shí)物總體框架65
• 4.2 系統(tǒng)實(shí)現(xiàn)與測試結(jié)果65-71
• 4.2.1 ADC的測試結(jié)果65-66
• 4.2.2 信道化模塊的實(shí)現(xiàn)結(jié)果66-68
• 4.2.3 參數(shù)編碼器模塊的實(shí)現(xiàn)結(jié)果68-71
• 4.3 本章小結(jié)71-72
• 第五章 總結(jié)與展望72-74
• 5.1 工作總結(jié)72
• 5.2 研究展望72-74
• 致謝74-75
• 參考文獻(xiàn)75-79
• 攻讀碩士學(xué)位期間取得的成果79-80

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