【摘要】：針對(duì)高速長(zhǎng)線數(shù)據(jù)傳輸中可靠性低的問(wèn)題,提出了一種均衡可靠性和高速傳輸?shù)脑O(shè)計(jì).設(shè)計(jì)中以LVDS作為傳輸高速接口,FPGA作為邏輯控制芯片,在硬件電路上加入均衡電路和軟件程序上采用正反差錯(cuò)編碼方式兩方面提高傳輸可靠性.對(duì)總體設(shè)計(jì)方案和各電路模塊進(jìn)行了詳細(xì)介紹和分析,以及對(duì)程序的實(shí)現(xiàn)進(jìn)行了描述.最后給出了設(shè)計(jì)的試驗(yàn)結(jié)果,驗(yàn)證了本設(shè)計(jì)的傳輸可靠性.
[Abstract]:Aiming at the problem of low reliability in high-speed long-distance data transmission, a design of equalization reliability and high-speed transmission is proposed. In the design, LVDS is used as the transmission high-speed interface, FPGA as the logic control chip, equalization circuit is added in the hardware circuit and the forward and inverse error coding mode is adopted in the software program to improve the transmission reliability. The overall design scheme and each circuit module are introduced and analyzed in detail, and the realization of the program is described. Finally, the experimental results of the design are given, and the reliability of the design is verified.
【作者單位】： 中北大學(xué)電子測(cè)試技術(shù)重點(diǎn)實(shí)驗(yàn)室;
【基金】：國(guó)家自然科學(xué)基金項(xiàng)目(61004127)
【分類(lèi)號(hào)】：TN919.6

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