【摘要】：脈沖超寬帶雷達回波信號由于帶寬大而難以直接采樣,文中設(shè)計并實現(xiàn)了一種基于FPGA的數(shù)字式脈沖超寬帶雷達接收機。該接收機利用FPGA內(nèi)嵌鎖相環(huán)產(chǎn)生特定頻率的時鐘,驅(qū)動四路10 bit ADC器件,根據(jù)回波信號在一段時間內(nèi)呈準(zhǔn)靜態(tài)及周期性的特點,實現(xiàn)了四通道時域偽隨機等效采樣。仿真及測試結(jié)果表明,該數(shù)字式脈沖超寬帶雷達接收機等效采樣速率可達10 GS/s,可有效接收雷達回波信號,滿足脈沖超寬帶雷達的應(yīng)用需求。
[Abstract]:The echo signal of pulse UWB radar is difficult to be sampled directly because of its large bandwidth. A digital UWB radar receiver based on FPGA is designed and implemented in this paper. The receiver uses the phase-locked loop (PLL) in FPGA to generate a clock of a specific frequency and drives four channels of 10 bit ADCs. According to the quasi-static and periodic characteristics of the echo signal in a certain period of time, the four-channel pseudo-random equivalent sampling in time domain is realized. The simulation and test results show that the equivalent sampling rate of the digital UWB radar receiver can reach 10 GS / s, which can effectively receive the radar echo signal and meet the application requirements of the pulse UWB radar.
【作者單位】： 桂林電子科技大學(xué)信息與通信學(xué)院;
【基金】：廣西自然科學(xué)基金資助項目(2013GXNSFFA019004,2013GXNSFFA019329) 廣西無線寬帶通信與信號處理重點實驗室主任基金資助項目(12107)
【分類號】：TN958

【參考文獻】

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本文編號：2120715