發(fā)布時(shí)間：2018-06-13 05:28

  本文選題：視頻壓縮 + JPEG�。� 參考：《南京大學(xué)》2014年碩士論文

【摘要】：隨著社會(huì)的不斷發(fā)展、生活水平的提高、工業(yè)自動(dòng)化不斷興起,人和人、人和公共基礎(chǔ)設(shè)施之間的突發(fā)事件也越來(lái)越頻繁,并且這些突發(fā)事件往往具有毫無(wú)征兆、難以預(yù)測(cè)的特征,在這些問(wèn)題面前,視頻監(jiān)控變得尤為重要�；贔PGA的處理技術(shù)具有性能穩(wěn)定、開(kāi)發(fā)周期短、配置靈活等特點(diǎn),因而在本系統(tǒng)中采用FPGA作為視頻監(jiān)控系統(tǒng)的核心處理器件。JPEG圖像編解碼算法是國(guó)際上關(guān)于靜止圖像和灰度圖像的第一個(gè)國(guó)際編碼標(biāo)準(zhǔn),JPEG不僅適用于靜止圖像的壓縮編碼,而且也可以用來(lái)作為視頻圖像的壓縮標(biāo)準(zhǔn)。本文詳細(xì)研究了基于FPGA的視頻圖像處理技術(shù),在此基礎(chǔ)上設(shè)計(jì)出一套系統(tǒng)軟硬件平臺(tái)。硬件部分包括視頻采集模塊、視頻編碼模塊和網(wǎng)絡(luò)傳輸模塊、網(wǎng)絡(luò)接收模塊、視頻解碼模塊、視頻顯示模塊。軟件部分包括JPEG圖像編解碼算法和基于LWIP的網(wǎng)絡(luò)傳輸協(xié)議。由于系統(tǒng)功能比較復(fù)雜,對(duì)FPGA芯片速度以及內(nèi)部邏輯資源要求較高,因此采用了XILINX公司的VIRTEX-II PRO系列的XC2VP50的FPGA芯片。本視頻監(jiān)控系統(tǒng)分為輸入端與輸出端兩部分。在輸入端,視頻圖像直接由攝像頭產(chǎn)生,經(jīng)由視頻編碼模塊將其壓縮為JPEG格式圖像數(shù)據(jù)。在輸出端,壓縮圖像數(shù)據(jù)通過(guò)視頻解碼模塊解碼后通過(guò)視頻顯示模塊在終端實(shí)現(xiàn)顯示。對(duì)于輸入端與輸出端之間的實(shí)時(shí)數(shù)據(jù)傳輸,采用移植在Xilinx FPGA上的嵌入式網(wǎng)絡(luò)Lwip協(xié)議棧,,使用UDP傳輸形式,從而在輸出端得到低延時(shí)的原始視頻圖像數(shù)據(jù)。
[Abstract]:With the continuous development of society, the improvement of living standards, the rising of industrial automation, the emergencies between people and people, between people and public infrastructure are more and more frequent, and these emergencies often have no warning. In the face of these problems, video surveillance becomes more and more important. The processing technology based on FPGA has the characteristics of stable performance, short development period, flexible configuration, etc. Therefore, using FPGA as the core processing device of video surveillance system. JPEG image coding and decoding algorithm is the first international coding standard for still image and gray image, JPEG is not only suitable for still image compression coding. It can also be used as a compression standard for video images. In this paper, the video image processing technology based on FPGA is studied in detail, and a software and hardware platform is designed. The hardware includes video acquisition module, video coding module and network transmission module, network receiving module, video decoding module and video display module. The software includes JPEG image coding and decoding algorithm and LWIP based network transmission protocol. Because of the complexity of the system function and the high requirement of FPGA chip speed and internal logic resources, the XC2VP50 FPGA chip of XILINX company's VIRTEX-II pro series is adopted. The video monitoring system is divided into two parts: input and output. At the input end, the video image is generated directly by the camera and compressed into JPEG format image data by the video coding module. At the output end, the compressed image data is decoded by the video decoding module and displayed at the terminal through the video display module. For the real-time data transmission between input and output, the embedded network Lwip protocol stack is transplanted on Xilinx FPGA, and UDP is used to transmit the original video image data with low delay at the output end.
【學(xué)位授予單位】：南京大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2014
【分類(lèi)號(hào)】：TN948.6

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本文編號(hào)：2012893