本文選題：北斗二代 + 高動(dòng)態(tài)�。� 參考：《計(jì)算機(jī)工程與設(shè)計(jì)》2014年03期

【摘要】：為提高北斗導(dǎo)航接收機(jī)在高動(dòng)態(tài)下的載波跟蹤性能,對(duì)載波跟蹤環(huán)的各個(gè)模塊和邏輯參數(shù)進(jìn)行了研究。利用變環(huán)路帶寬技術(shù),提出了一種環(huán)路參數(shù)可調(diào)的載波跟蹤環(huán)。通過(guò)對(duì)FLL(鎖頻環(huán))和PLL(鎖相環(huán))的具體分析,設(shè)計(jì)并實(shí)現(xiàn)了一種基于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)和高性能數(shù)字信號(hào)處理器(DSP)的載波環(huán)路跟蹤方案,在DSP端進(jìn)行環(huán)路控制,在FPGA端完成載波的剝離。測(cè)試結(jié)果表明,該方案能實(shí)現(xiàn)高動(dòng)態(tài)下載波信號(hào)的快速精確跟蹤,具有良好的實(shí)時(shí)性和推廣價(jià)值。
[Abstract]:In order to improve the carrier tracking performance of the Beidou navigation receiver under high dynamic conditions, the various modules and logic parameters of the carrier tracking loop are studied. A carrier tracking loop with adjustable loop parameters is proposed using variable loop bandwidth technology. A carrier loop tracking scheme based on field programmable gate array (FPGA) and high performance digital signal processor (DSP) is designed and implemented by analyzing the frequency locked loop (FLL) and phase locked loop (PLL), and the loop control is implemented at the DSP end. The carrier is peeled off at the FPGA end. The test results show that the proposed scheme can realize fast and accurate tracking of high dynamic downloadable wave signals, and has good real-time and popularizing value.
【作者單位】： 桂林電子科技大學(xué)信息與通信學(xué)院;
【基金】：國(guó)家自然科學(xué)基金重點(diǎn)項(xiàng)目(11033004);國(guó)家自然科學(xué)基金項(xiàng)目(60263028) 中國(guó)科學(xué)院精密導(dǎo)航定位與定時(shí)技術(shù)重點(diǎn)實(shí)驗(yàn)室開(kāi)放基金項(xiàng)目(2012PNTT04) 中國(guó)科學(xué)院時(shí)間頻率基準(zhǔn)重點(diǎn)實(shí)驗(yàn)室基金項(xiàng)目(y000yr1s01)
【分類(lèi)號(hào)】：TN965.5

【參考文獻(xiàn)】

相關(guān)期刊論文 前6條

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【共引文獻(xiàn)】

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【二級(jí)參考文獻(xiàn)】

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【相似文獻(xiàn)】

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1 劉亮;李署堅(jiān);邵定蓉;;一種高動(dòng)態(tài)USB應(yīng)答機(jī)的設(shè)計(jì)與實(shí)現(xiàn)[J];電子技術(shù)應(yīng)用;2008年06期

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4 朱佳佳;牟榮增;閻躍鵬;;π/4DQPSK載波跟蹤環(huán)的設(shè)計(jì)與實(shí)現(xiàn)[J];通信技術(shù);2010年09期

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6 羅t，

本文編號(hào)：1924664