發(fā)布時(shí)間：2018-04-10 07:39

  本文選題：低密度奇偶校驗(yàn)碼　切入點(diǎn)：加權(quán)比特翻轉(zhuǎn)算法　出處：《北京郵電大學(xué)學(xué)報(bào)》2014年02期

【摘要】：為了提高低密度奇偶校驗(yàn)碼(LDPC)譯碼器的譯碼速度,提出了一種基于部分并行比特選擇機(jī)制的快速多比特翻轉(zhuǎn)算法.根據(jù)接收向量中錯(cuò)誤具有隨機(jī)分布的特點(diǎn),將所有比特劃分成若干子塊,從每個(gè)子塊挑選出1個(gè)候選翻轉(zhuǎn)比特,再從這些候選比特中挑選出合理數(shù)目的比特進(jìn)行翻轉(zhuǎn),完成譯碼迭代.此外,通過引入樹形搜索和數(shù)據(jù)池技術(shù)降低該算法核心模塊的計(jì)算復(fù)雜度,以進(jìn)一步增加算法硬件實(shí)現(xiàn)時(shí)的譯碼速度.分析結(jié)果表明,相較于多比特翻轉(zhuǎn)算法,利用所提出的算法和相關(guān)硬件實(shí)現(xiàn)技術(shù),譯碼器的吞吐量能得到明顯的提高.仿真結(jié)果驗(yàn)證了快速多比特翻轉(zhuǎn)算法的有效性.
[Abstract]:In order to improve the decoding speed of low density parity check (LDPC) decoder, a fast multi-bit flipping algorithm based on partial parallel bit selection mechanism is proposed.According to the random distribution of errors in the receiving vector, all bits are divided into subblocks, one candidate flip bit is selected from each subblock, and a reasonable number of bits are selected from these candidate bits to flip.Complete decoding iteration.In addition, tree search and data pool techniques are introduced to reduce the computational complexity of the core module of the algorithm, so as to further increase the decoding speed when the algorithm is implemented in hardware.The analysis results show that the throughput of the decoder can be significantly improved by using the proposed algorithm and the related hardware implementation technology compared with the multi-bit flipping algorithm.Simulation results verify the effectiveness of the fast multibit flipping algorithm.
【作者單位】： 西安電子科技大學(xué)綜合業(yè)務(wù)網(wǎng)理論及關(guān)鍵技術(shù)國家重點(diǎn)實(shí)驗(yàn)室;
【基金】：高等學(xué)校學(xué)科創(chuàng)新引智計(jì)劃資助項(xiàng)目(B08038) 西安電子科技大學(xué)自主科研項(xiàng)目(72001859)
【分類號】：TN911.22

【參考文獻(xiàn)】

相關(guān)期刊論文 前1條

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【共引文獻(xiàn)】

相關(guān)期刊論文 前2條

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【二級參考文獻(xiàn)】

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【相似文獻(xiàn)】

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相關(guān)碩士學(xué)位論文 前10條

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本文編號：1730290