發(fā)布時(shí)間：2018-03-06 04:20

  本文選題：Vivado　切入點(diǎn)：HLS　出處：《實(shí)驗(yàn)室研究與探索》2014年12期 　論文類型：期刊論文

【摘要】：介紹一種基于FPGA的AC97音頻系統(tǒng)設(shè)計(jì)。系統(tǒng)的核心部件采用Xilinx Atlys的板載Spartan6 XCSLX45芯片,使用的工具為Xilinx的高層次綜合技術(shù)Vivado HLS。首先使用C/C++代碼編寫的算法描述系統(tǒng)的FIR濾波器;然后按照Vivado HLS編譯工具的規(guī)范,將程序代碼轉(zhuǎn)換為RTL模型,快速、直接地生成對應(yīng)左右聲道的FIR IP核和綜合結(jié)果;再結(jié)合互連的Micro Blaze處理器IP核,處理一段立體聲音樂信號,通過這種軟硬件協(xié)同設(shè)計(jì)的方法,實(shí)現(xiàn)了音頻濾波系統(tǒng)由現(xiàn)有算法向高性能的FPGA系統(tǒng)中移植的設(shè)計(jì)。結(jié)果表明,系統(tǒng)能夠有效地濾除指定音頻中的噪聲,并且通過優(yōu)化設(shè)計(jì)和架構(gòu)探索,可以獲得最佳資源消耗和性能優(yōu)化的組合。
[Abstract]:This paper introduces the design of a AC97 audio system based on FPGA. The core component of the system is the Spartan6 XCSLX45 chip of Xilinx Atlys, and the tool is Vivado HLS, a high-level synthesis technology of Xilinx. Firstly, the FIR filter of the system is described by the algorithm written by C / C code. Then, according to the specification of Vivado HLS compiling tool, the program code is converted into RTL model, and the FIR IP core and synthesis result corresponding to left and right channel are generated quickly and directly, and then a stereo music signal is processed with the interconnecting Micro Blaze processor IP core. Through this method of hardware and software co-design, the design of the audio filtering system is realized, which is transplanted from the existing algorithm to the high performance FPGA system. The results show that the system can effectively filter the noise in the specified audio frequency. The optimal combination of resource consumption and performance optimization can be obtained through optimization design and architecture exploration.
【作者單位】： 南京大學(xué)電子科學(xué)與工程學(xué)院;
【基金】：江蘇省高等教育教改研究立項(xiàng)課題(2013JSJG169)
【分類號】：TN791;TN912.3

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本文編號：1573304