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WIFI系統(tǒng)中QC-LDPC編碼算法研究與FPGA實(shí)現(xiàn)

發(fā)布時(shí)間:2018-02-21 08:36

  本文關(guān)鍵詞: 低密度奇偶校驗(yàn)碼 準(zhǔn)循環(huán) Efficient編碼算法 現(xiàn)場(chǎng)可編程門(mén)陣列 出處:《電子科技大學(xué)》2014年碩士論文 論文類型:學(xué)位論文


【摘要】:LDPC碼的全稱是低密度奇偶校驗(yàn)碼,它是線性分組碼的一種,目前在通信領(lǐng)域得到了廣泛的應(yīng)用,為多種標(biāo)準(zhǔn)所采用。同Turbo碼一樣,它有著接近香農(nóng)限的優(yōu)異性能,并且LDPC碼的誤碼率可以通過(guò)多次迭代譯碼的方法來(lái)有效地降低。LDPC碼的校驗(yàn)矩陣具有稀疏特性,有利于簡(jiǎn)化編碼時(shí)的計(jì)算復(fù)雜度,而QC-LDPC碼則是通過(guò)對(duì)基礎(chǔ)矩陣進(jìn)行循環(huán)移位而得到的一種具有循環(huán)特性的LDPC碼,這種循環(huán)特性使它減少了編譯碼過(guò)程中存儲(chǔ)校驗(yàn)矩陣所需要的存儲(chǔ)空間,進(jìn)一步的簡(jiǎn)化了編譯碼的過(guò)程。本文所要實(shí)現(xiàn)的是基于WIFI系統(tǒng)的數(shù)據(jù)傳輸,需要較高的吞吐率與時(shí)鐘頻率,較低的誤碼率以及可接受的資源消耗。為解決這一問(wèn)題,本文選擇了QC-LDPC碼的Efficient編碼算法,并對(duì)該算法進(jìn)行了硬件實(shí)現(xiàn),最后給出了具體的硬件指標(biāo)。在對(duì)線性分組碼的相關(guān)概念進(jìn)行介紹之后,本文簡(jiǎn)述了LDPC碼的概念、分類以及編譯碼的基本原理。然后分析了通過(guò)生成矩陣進(jìn)行編碼的LDPC編碼算法的復(fù)雜度,并與Efficient編碼算法的復(fù)雜度進(jìn)行了對(duì)比,前者復(fù)雜度為O(),后者為O(n);谙到y(tǒng)的需求,本文選擇了Efficient算法來(lái)進(jìn)行LDPC碼的編碼。針對(duì)該算法,本文給出了QC-LDPC編碼器的設(shè)計(jì)方案以及個(gè)子模塊的電路結(jié)構(gòu),并對(duì)各模塊進(jìn)行了功能仿真。設(shè)計(jì)的編碼器可以兼容四種碼率,編碼器頂層接口時(shí)序的正確性也通過(guò)功能仿真得到了驗(yàn)證。在進(jìn)行測(cè)試與驗(yàn)證時(shí),本文將編碼器編碼產(chǎn)生的碼字與相關(guān)控制信息通過(guò)串口一起傳回PC,通過(guò)Matlab來(lái)分析編碼結(jié)果是否正確,以此完成驗(yàn)證過(guò)程。文中給出了驗(yàn)證平臺(tái)中各模塊的設(shè)計(jì)方案,最后得到了驗(yàn)證結(jié)果以及編碼器所能達(dá)到的硬件指標(biāo)本文所設(shè)計(jì)的QC-LDPC編碼器達(dá)到了系統(tǒng)要求,最后實(shí)現(xiàn)的指標(biāo)如下:輸入位寬32bit;輸出位寬96bit;穩(wěn)定時(shí)鐘頻率200MHz,最高時(shí)鐘頻率250MHz,關(guān)鍵路徑延遲為3.761ns;吞吐率為5Gbps;碼長(zhǎng)2304bit,碼率為5/6時(shí),在信噪比為3dB的情況下,通過(guò)BP譯碼算法進(jìn)行譯碼后,所得的誤碼率為10-7,滿足系統(tǒng)所提出的指標(biāo)要求。
[Abstract]:The full name of LDPC code is low density parity check code. It is a kind of linear block code. It has been widely used in the field of communication and adopted by many standards. Like Turbo code, it has excellent performance close to Shannon limit. Moreover, the error rate of LDPC codes can be effectively reduced by multiple iterative decoding, which can reduce the sparse property of the check matrix of the. LDPC codes, which is helpful to simplify the computational complexity of the codes. The QC-LDPC code is a kind of LDPC code with cyclic property, which reduces the storage space needed to store the check matrix in the process of encoding and decoding. In order to solve this problem, the data transmission based on WIFI system needs high throughput and clock frequency, low bit error rate and acceptable resource consumption. In this paper, the Efficient coding algorithm of QC-LDPC code is selected, and the algorithm is implemented in hardware. Finally, the specific hardware specifications are given. After introducing the related concepts of linear block code, the concept of LDPC code is briefly described. Then, the complexity of LDPC coding algorithm based on generating matrix is analyzed and compared with that of Efficient coding algorithm. In this paper, Efficient algorithm is chosen to encode the LDPC code. For this algorithm, the design scheme of the QC-LDPC encoder and the circuit structure of the sub-module are given, and the functional simulation of each module is carried out. The encoder designed can be compatible with four code rates. The correctness of the timing of the top-level interface of the encoder is also verified by functional simulation. In this paper, the codewords generated by encoder coding and related control information are transmitted back to PCC through serial port, and the code result is analyzed by Matlab to complete the verification process. The design scheme of each module in the verification platform is given in this paper. Finally, the verification results and the hardware specifications of the encoder are obtained. The QC-LDPC encoder designed in this paper meets the requirements of the system. The results are as follows: input bit width 32 bit; output bit width 96 bit; stable clock frequency 200 MHz, maximum clock frequency 250 MHz, critical path delay 3.761 ns; throughput 5 Gbps. code length 2304 bit, code rate 5/6, when SNR is 3 dB, After decoding by BP decoding algorithm, the BER is 10 ~ (-7), which meets the requirements of the system.
【學(xué)位授予單位】:電子科技大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2014
【分類號(hào)】:TN92;TN911.22

【共引文獻(xiàn)】

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2 寧平;;IEEE 802.16e標(biāo)準(zhǔn)中LDPC編碼的實(shí)現(xiàn)與仿真[J];電子技術(shù)應(yīng)用;2014年09期

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本文編號(hào):1521499

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