本文關(guān)鍵詞：基于DSP嵌入式平臺(tái)的高清網(wǎng)絡(luò)攝像機(jī)的硬件設(shè)計(jì)與實(shí)現(xiàn)

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【摘要】：隨著社會(huì)經(jīng)濟(jì)發(fā)展和社會(huì)治安形勢(shì)的變化,安全防范日顯重要,視頻監(jiān)控成為了社會(huì)治安動(dòng)態(tài)防范系統(tǒng)的利劍之一。對(duì)于視頻監(jiān)控而言,采集的有效視頻圖像的清晰度無(wú)疑是最關(guān)鍵的技術(shù)要素,圖像清晰度是視頻監(jiān)控永恒的追求。高清視頻監(jiān)控技術(shù)獲得了重大突破,高清視頻監(jiān)控逐步成為市場(chǎng)主流。網(wǎng)絡(luò)技術(shù)、視頻壓縮編碼技術(shù)、高性能處理器設(shè)計(jì)制造技術(shù)的不斷發(fā)展為開(kāi)大規(guī)模普及應(yīng)用高清網(wǎng)絡(luò)攝像機(jī)迎來(lái)了契機(jī)。本課題將探索、研究高清網(wǎng)絡(luò)攝像機(jī)所需要掌握的關(guān)鍵技術(shù),網(wǎng)絡(luò)攝像機(jī)的硬件平臺(tái)搭建。課題的主要目標(biāo)是在DSP嵌入式平臺(tái)上研究高清網(wǎng)絡(luò)攝像機(jī)的電路設(shè)計(jì)。與以往10MHz頻率的處理器不同,電路設(shè)計(jì)中越來(lái)越多的使用100MHz甚至GHz級(jí)別的處理器。這就對(duì)電路設(shè)計(jì)提出了更高的要求。在高速電路設(shè)計(jì)領(lǐng)域,不僅要在有限的空間排布開(kāi)元件、連通信號(hào),更要關(guān)注信號(hào)完整性問(wèn)題。本課題首先通過(guò)元件選型進(jìn)行核心原理圖設(shè)計(jì)。之后對(duì)攝像機(jī)中高速電路部分關(guān)注的信號(hào)完整性問(wèn)題進(jìn)行分析,通過(guò)理解傳輸線的特性阻抗及信號(hào)在傳輸線上的傳播方式,在此基礎(chǔ)上對(duì)信號(hào)的反射、串?dāng)_、時(shí)延以及地彈等進(jìn)行研究。通過(guò)理論分析得出初步的設(shè)計(jì)約束,之后結(jié)合仿真工具HyperLynx對(duì)實(shí)際設(shè)計(jì)的DDR2高速電路部分進(jìn)行仿真,運(yùn)用仿真軟件的前仿真和后仿真給出電路板中高速信號(hào)部分PCB設(shè)計(jì)的實(shí)際設(shè)計(jì)規(guī)則。同時(shí)兼顧電源完整性設(shè)計(jì),通過(guò)分析去耦電容的數(shù)量以及電源平面的直流壓降,給出核電壓供電的設(shè)計(jì)方法,在設(shè)計(jì)之初就得到合理的電容排布與電源線走線設(shè)定。最終在多種規(guī)則的指導(dǎo)下完成攝像機(jī)的設(shè)計(jì)。高效、快捷的設(shè)計(jì)完成電路板,并通過(guò)可靠性測(cè)試證明設(shè)計(jì)電路的可靠性。
【關(guān)鍵詞】：高清網(wǎng)絡(luò)攝像機(jī) 信號(hào)完整性 反射 串?dāng)_ 時(shí)序 HyperLynx
【學(xué)位授予單位】：中國(guó)科學(xué)院大學(xué)(工程管理與信息技術(shù)學(xué)院)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類號(hào)】：TN948.41
【目錄】：

• 摘要5-6
• Abstract6-10
• 第一章 緒論10-18
• 1.1 高清網(wǎng)絡(luò)攝像機(jī)研究背景與意義10-11
• 1.2 高速電路設(shè)計(jì)發(fā)展概述11-14
• 1.3 信號(hào)完整性問(wèn)題14-15
• 1.4 EMI電磁兼容問(wèn)題15
• 1.5 本文的研究?jī)?nèi)容與結(jié)構(gòu)安排15-18
• 第二章 DM6467T編碼板電路設(shè)計(jì)18-28
• 2.1 主控芯片選型18-19
• 2.2 基于TMS320DM6467T高清網(wǎng)絡(luò)攝像機(jī)整體設(shè)計(jì)19-21
• 2.3 編碼板主要模塊設(shè)計(jì)21-25
• 2.3.1 電源模塊21-23
• 2.3.2 時(shí)鐘模塊23-24
• 2.3.3 NOR FLASH模塊24
• 2.3.4 DDR2-800 SDRAM模塊24-25
• 2.4 本章小結(jié)25-28
• 第三章 基于DM6467T的編碼板設(shè)計(jì)28-50
• 3.1 編碼板拓?fù)浣Y(jié)構(gòu)28-30
• 3.2 返回路徑設(shè)計(jì)30-32
• 3.2.1 走線變換時(shí)的參考平面設(shè)計(jì)方案31-32
• 3.3 疊層的重要性32-36
• 3.3.1 編碼板疊層結(jié)構(gòu)設(shè)計(jì)33
• 3.3.2 編碼板阻抗設(shè)計(jì)33-36
• 3.4 編碼板PCB的信號(hào)完整性設(shè)計(jì)36-38
• 3.4.1 編碼板高速信號(hào)的信號(hào)完整性分析36-38
• 3.4.2 傳輸線理論38
• 3.4.3 編碼板上的高速信號(hào)38
• 3.5 編碼板反射與阻抗匹配38-42
• 3.5.1 反射的基本概念38-39
• 3.5.2 阻抗匹配39-40
• 3.5.3 振鈴40-41
• 3.5.4 編碼板關(guān)鍵走線仿真41-42
• 3.6 編碼板串?dāng)_抑制設(shè)計(jì)42-47
• 3.6.1 串?dāng)_的基本概念42-43
• 3.6.2 串?dāng)_的形成機(jī)理43-45
• 3.6.3 編碼板串?dāng)_抑制設(shè)計(jì)45-47
• 3.7 本章小結(jié)47-50
• 第四章 編碼板PCB的電源完整性設(shè)計(jì)50-56
• 4.1 編碼板電源設(shè)計(jì)50-51
• 4.2 電源去耦51-53
• 4.2.1 去耦電容的作用51-52
• 4.2.2 電容器的布局52-53
• 4.3 PCB直流壓降53-54
• 4.2.1 編碼板電壓需求分析53-54
• 4.2.2 編碼板直流壓降仿真54
• 4.4 本章小結(jié)54-56
• 第五章 編碼板的時(shí)序設(shè)計(jì)56-66
• 5.1 時(shí)序系統(tǒng)簡(jiǎn)介56
• 5.2 編碼板時(shí)序簡(jiǎn)介56-58
• 5.2.1 源同步建立時(shí)間時(shí)序分析56-58
• 5.2.2 保持時(shí)間時(shí)序分析58
• 5.3 DDR2時(shí)序58-61
• 5.3.1 DDR2基本概念簡(jiǎn)介58-60
• 5.3.2 “等長(zhǎng)”的重要性60-61
• 5.4 編碼板DDR2-800時(shí)序設(shè)計(jì)61-63
• 5.4.1 地址和控制信號(hào)時(shí)序設(shè)計(jì)61-62
• 5.4.2 數(shù)據(jù)信號(hào)時(shí)序設(shè)計(jì)62-63
• 5.4.3 地址時(shí)鐘與數(shù)據(jù)時(shí)鐘時(shí)序設(shè)計(jì)63
• 5.5 編碼板信號(hào)線走線規(guī)則63
• 5.6 編碼板數(shù)據(jù)信號(hào)時(shí)序仿真63-64
• 5.7 設(shè)計(jì)完成的編碼板64-65
• 5.8 本章小結(jié)65-66
• 第六章 電磁兼容與可靠性測(cè)試66-76
• 6.1 電磁兼容設(shè)計(jì)66
• 6.1.2 電磁兼容設(shè)計(jì)的基本內(nèi)容66
• 6.2 布線優(yōu)化66-67
• 6.3 接地優(yōu)化67-69
• 6.3.1 接地方式67-68
• 6.3.2 數(shù)�；旌蠒r(shí)的接地方式68-69
• 6.3.3 PCB板鋪地的碎銅處理69
• 6.4 可靠性驗(yàn)證69-72
• 6.4.1 成像質(zhì)量測(cè)試70-71
• 6.4.2 高低溫環(huán)境測(cè)試71-72
• 6.5 電磁兼容測(cè)試72-75
• 6.5.1 攝像機(jī)輻射測(cè)試72-73
• 6.5.2 電源傳導(dǎo)測(cè)試73-75
• 6.6 本章小結(jié)75-76
• 第七章 結(jié)論與展望76-78
• 7.1 結(jié)論76-77
• 7.2 展望77-78
• 參考文獻(xiàn)78-80
• 致謝80-81
• 個(gè)人簡(jiǎn)歷、在學(xué)期間發(fā)表的論文與研究成果81

【參考文獻(xiàn)】

中國(guó)期刊全文數(shù)據(jù)庫(kù) 前1條

1 柴林峰;蔣留兵;柳政枝;黃韜;;基于數(shù)字電路系統(tǒng)的高速PCB信號(hào)完整性分析[J];桂林電子科技大學(xué)學(xué)報(bào);2012年02期

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本文編號(hào)：1087838