本文關(guān)鍵詞： 三維圖形渲染 能耗估計模型 著色器 預(yù)測誤差　出處：《西安電子科技大學(xué)學(xué)報》2017年04期 　論文類型：期刊論文

【摘要】：針對硬件設(shè)計和圖形編程,提出了一種新的三維圖形渲染計算階段的能耗估計模型.針對三維渲染管線中頂點著色器和像素著色器的能耗問題,對影響渲染質(zhì)量的頂點著色和像素著色的負載進行了分析,得出了像素數(shù)與頂點數(shù)的比值模型;同時,對頂點著色階段和像素著色階段的能耗進行了建模.用所建立的模型對基準測試程序進行了能耗估計,使用Synopsys VCS(Verilog Compiled Simulator)仿真器和Power Compiler來執(zhí)行仿真,得到不同測試程序的實際能耗.驗證結(jié)果表明,該模型預(yù)測誤差的幾何平均值小于3%,達到了較高的估計精度,可用于指導(dǎo)圖形硬件和軟件的功耗分析和管理.
[Abstract]:For hardware design and graphics programming, a new energy consumption estimation model for 3D graphics rendering calculation stage is proposed, aiming at the energy consumption of vertex shader and pixel shader in 3D rendering pipeline. Based on the analysis of the load of vertex coloring and pixel coloring, the ratio model of pixel number to vertex number is obtained. The energy consumption of vertex coloring phase and pixel coloring phase is modeled, the benchmark program is estimated by the established model, and the simulation is performed by using Synopsys VCS(Verilog Compiled Simulator and Power Compiler. The actual energy consumption of different test programs is obtained. The verification results show that the geometric mean value of the prediction error is less than 3, which can be used to guide the power analysis and management of graphics hardware and software.
【作者單位】： 西安電子科技大學(xué)微電子學(xué)院;西安郵電大學(xué)電子工程學(xué)院;
【基金】：國家自然科學(xué)基金重點資助項目(61136002)
【分類號】：TP391.41

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本文編號：1503023