本文關(guān)鍵詞：DDR3-SDRAM控制器設(shè)計(jì)及FPGA實(shí)現(xiàn)

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【摘要】：針對(duì)自適應(yīng)接收機(jī)中高速A/D采樣數(shù)據(jù)對(duì)高帶寬和大容量的需求,提出一種DDR3控制器設(shè)計(jì)方案。采用在MIG IP核的基礎(chǔ)上添加用戶接口控制程序的設(shè)計(jì)方法,利用ZC706評(píng)估板實(shí)現(xiàn)了DDR3的讀寫(xiě)控制。設(shè)計(jì)方案具有較高的可移植性和簡(jiǎn)單的用戶接口,可以靈活地應(yīng)用到不同的工程中。仿真和板級(jí)測(cè)試表明,DDR3可在800 MHz的接口頻率工作,傳輸速度可達(dá)1 600 MT/s,驗(yàn)證了系統(tǒng)的可行性和正確性,其將有助于解決海量數(shù)據(jù)的高速緩存問(wèn)題。
【作者單位】： 西南科技大學(xué)信息工程學(xué)院;特殊環(huán)境機(jī)器人技術(shù)四川省重點(diǎn)實(shí)驗(yàn)室;
【關(guān)鍵詞】： 存儲(chǔ)器 控制器 FPGA 高帶寬 大容量 用戶接口 數(shù)據(jù)模塊 模數(shù)轉(zhuǎn)換
【基金】：國(guó)防基礎(chǔ)科研計(jì)劃基金資助項(xiàng)目(編號(hào):B3120133002)
【分類(lèi)號(hào)】：TP333
【正文快照】： 0引言當(dāng)前,在諸多通信芯片和系統(tǒng)的研發(fā)中,經(jīng)常用到各種大容量、高速讀寫(xiě)存儲(chǔ)器件。同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器(synchronous dynamic random access memory,SDRAM)以其價(jià)格低、速度快、容量大等特點(diǎn),廣受開(kāi)發(fā)者的青睞[1]。其中,DDR2和DDR3發(fā)展成熟、應(yīng)用廣泛。DDR3在DDR2的基礎(chǔ)上有了

【相似文獻(xiàn)】

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本文編號(hào)：961102