本文關(guān)鍵詞：基于協(xié)議控制器的DDR3訪存控制器的設(shè)計(jì)及優(yōu)化

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【摘要】：為了完成SoC系統(tǒng)中片外DDR3存儲(chǔ)器高效訪問,實(shí)現(xiàn)了基于協(xié)議控制器的DDR3訪存控制器.針對(duì)SoC系統(tǒng)層訪問事務(wù)屬性與DDR3存儲(chǔ)器突發(fā)訪問屬性要求之間的不匹配問題,設(shè)計(jì)了一種訪問請(qǐng)求平滑處理機(jī)制,充分利用協(xié)議控制器的DDR3訪問命令緩沖,用更少的DDR3存儲(chǔ)器訪問請(qǐng)求完成SoC上層讀寫事務(wù),提高了整個(gè)DDR3訪存控制器的訪問效率.采用Verilog語(yǔ)言完成了邏輯設(shè)計(jì)和物理實(shí)現(xiàn),并采用人工綜合激勵(lì)的方法對(duì)訪問請(qǐng)求平滑機(jī)制進(jìn)行了評(píng)估,實(shí)驗(yàn)證明該優(yōu)化機(jī)制可對(duì)DDR3訪存控制器實(shí)現(xiàn)有效加速.
【作者單位】： 國(guó)防科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院;
【關(guān)鍵詞】： DDR 訪存控制 請(qǐng)求平滑
【基金】：國(guó)家自然科學(xué)基金項(xiàng)目(61402500)
【分類號(hào)】：TP333
【正文快照】： 1引言DDR3SDRAM[1](下文簡(jiǎn)稱DDR3)是SoC系統(tǒng)中常用的一種片外存儲(chǔ)器[2],其主要優(yōu)點(diǎn)是成本低、集成度高、容量大、速率快、峰值帶寬高.DDR3在較高的頻率下采用源同步的并行總線傳輸信號(hào),這對(duì)時(shí)序和信號(hào)完整性的要求極高.因此,SoC系統(tǒng)直接集成專用的DDR3協(xié)議控制器(包含協(xié)議層控

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本文編號(hào)：705102