基于FPGA的DDR3 SDRAM控制器設(shè)計(jì)及實(shí)現(xiàn)
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【摘要】:DDR3 SDRAM是第三代雙倍數(shù)據(jù)傳輸速率同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器,以其大容量、高速率和良好的兼容性得到了廣泛應(yīng)用。文中介紹了DDR3的特點(diǎn)和操作原理,以及利用MIG軟件工具在Virtex-6系列FPGA中實(shí)現(xiàn)DDR3 SDRAM控制器的設(shè)計(jì)方法,并進(jìn)行硬件測(cè)試。驗(yàn)證了DDS3控制器的可行性,其工作穩(wěn)定、占用資源少、可植性強(qiáng)等。
【作者單位】: 西安電子科技大學(xué)電子工程學(xué)院;
【關(guān)鍵詞】: FPGA DDR SDRAM控制器 MIG
【分類(lèi)號(hào)】:TN791;TP333
【正文快照】: DDR3 SDRAM是從DDR、DDR2發(fā)展而來(lái)的一種高速同步動(dòng)態(tài)隨機(jī)訪(fǎng)問(wèn)存儲(chǔ)器。由于DDR3 SDRAM可以在脈沖的上升和下降沿都傳輸數(shù)據(jù),因此傳輸數(shù)據(jù)的等效頻率是工作頻率的兩倍。與DDR2相比,DDR3主要有以下優(yōu)勢(shì):(1)DDR3采用8-bit預(yù)取技術(shù),解決了外部數(shù)據(jù)傳輸率與核心頻率之間的矛盾,保證
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,本文編號(hào):614679
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