本文關(guān)鍵詞：基于流訪問特征的多級硬件預(yù)取

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【摘要】：硬件數(shù)據(jù)預(yù)取技術(shù)將處理器可能訪問的數(shù)據(jù)提前裝入Cache中,使得處理器訪存時盡量命中Cache,提升系統(tǒng)性能。但現(xiàn)有研究和應(yīng)用主要對一級Cache進(jìn)行預(yù)取,預(yù)取的數(shù)據(jù)可能在使用前無法及時裝入Cache,從而降低硬件預(yù)取對系統(tǒng)性能的提升效果。針對上述問題,以流訪問特征的預(yù)取為基礎(chǔ),提出一種同時對多級Cache進(jìn)行預(yù)取的方法,并對流訪問特征的預(yù)取進(jìn)行實現(xiàn)。基于SPEC CPU2000測試程序集的實驗結(jié)果表明,與僅對一級Cache進(jìn)行預(yù)取相比,對多級Cache同時進(jìn)行預(yù)取可以將整數(shù)程序的性能平均提升2.11%,最高提升11.19%,浮點程序的性能平均提升3.08%,最高提升12.77%。
【作者單位】： 上海高性能集成電路設(shè)計中心;
【關(guān)鍵詞】： 存儲墻 流訪問 處理器 多級Cache 硬件預(yù)取
【基金】：“核高基”重大專項“超級計算機處理器研發(fā)”(2013ZX01028-001-001-001)
【分類號】：TP332
【正文快照】： 一段時間內(nèi)可能訪問的數(shù)據(jù)提前裝入Cache。當(dāng)處1概述理器訪問這些數(shù)據(jù)時可以直接命中Cache,緩解了近年來,存儲墻問題成為處理器性能提升的主Cache訪問缺失造成的長延遲問題,提升了處理器的要瓶頸,并且在多核架構(gòu)下,該問題變得更加嚴(yán)訪存性能。重[1]。為了緩解這個問題,很多技

【相似文獻(xiàn)】

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